Université de Ferhat Abbas Sétif-1
Faculté de technologie
Département Electrotechnique
Master Automatisation des processus industriels
Module : FPGA et programmation VHDL (MAP 82)
Série de TD N° 2
Exercice 1 :
Programmer le PROM suivant pour implémenter les fonctions logiques suivantes F0, F1 et F2 :
F0=T3+T2, F1=T1+T2 ? F2+T1+T3
On donne :
T 1 = A3. A2. A2. A0;
T 2 = A3. A2. A0;
T 3 = A3. A 2
Etiqueter correctement les ports d’entrée et
de sortie, et placer des boulets (•) aux
intersections de lignes à relier ensemble.
Exercice 2 :
Programmer le PROM de l’exercice1 pour implémenter la table de multiplication d’un nombre N≤7 Par le
nombre 3.
Etiqueter correctement les ports d’entrée et de sortie, et placer des boulets (•) aux intersections de lignes à
relier ensemble.
Exercice 3 :
Quelle sont les similarités architecturales entre :
a. Une PROM et un PLA ?
b. Un PLA et un PAL ?
c. Un PAL et un CPLD ?
Exercice 4 :
Donnez Les équations correspondantes
au circuit implémente sur le PLA ci-
contre.
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Exercice 5 :
Compléter le circuit PAL donné pour implémenter la
fonctionnalité du circuit dont les entrées sont : x1, x2
et x3. Les fonctions de sorties sont données par les
équations : y1 = x1 x3 , y 2 = p3 + p 4 . On donne :
p3 = x1.x 2 et p 4 = x1.x 2.x 3; Etiqueter correctement
les ports d’entrée et de sortie, et placer des boulets (•)
aux intersections des lignes à relier ensemble.
Exercice 6 :
Implémentez le module Additionneur complet décrit part le logigramme suivant avec la
ROM donnée, le PLA donné, le PAL donné
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