Corrigé série 5
Mme TAMEN 1
Exercice 1
• Combien de bascules sont nécessaires pour le MAR et le MBR d’une
mémoire 1 K*4 bits?
𝑀 = 1 𝐾 ∗ 4 𝑏𝑖𝑡𝑠 = 2,- ∗ 4 𝑏𝑖𝑡𝑠
• k=10 = nombre de lignes d’adresse = nombre de bits du MAR =
nombres de bascules du registre d’adresse MAR.
• n=4 = nombre de lignes de données = nombre de bits du MBR =
nombres de bascules du registre de données MBR.
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Exercice 1
• Combien de mots, devrait contenir une mémoire si son MAR est de 8
bits?
Le MAR contient 8 bits donc le nombre de mots = 2. = 256 mots.
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Exercice 1
En utilisant comme unité des RAM 256*4 bits, concevoir une mémoire
de:
• 1 K*4 bits
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Exercice 1
En utilisant comme unité des RAM 256*4 bits, concevoir une mémoire
de :
• 1 K*8 bits
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Exercice 3
• Soit une mémoire RAM de 4Kilos*4 représentée par le shéma
suivant :
Mme TAMEN 6
Exercice 3
1 𝑒𝑡 𝐶𝑆 dans un circuit mémoire.
Quel est le rôle des broches 𝑅/𝑊
• CS sert à sélectionner le boitier : (cas de la logique positive)
• Si CS=1 à boitier sélectionné à possibilité d’opérations
• Si CS=0 à boitier non sélectionné à aucune possibilité d’opérations
1 sert à sélectionner l’opération à effectuer sur le boitier
• 𝑅/𝑊
1 = 1 à opération de lecture
• Si 𝑅/𝑊
1 = 0 à opération d’écriture
• Si 𝑅/𝑊
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Exercice 3
De combien de bits est constituée la donnée stockée dans cette
mémoire.
Le bus de données contient 4 bits donc la donnée dans cette mémoire
contient 4 bits: D3D2D1D0.
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Exercice 3
De quelle capacité est cette mémoire (en Kbits puis en Koctets).
𝑀 = 4𝐾 ∗ 4 = 16𝐾𝑏𝑖𝑡𝑠 = 2𝐾𝑜𝑐𝑡𝑒𝑡𝑠
Mme TAMEN 9
Exercice 3
Quel doit être l’état du signal VMA (Valid Memory Access) et l’état des
lignes A12 à A15 pour sélectionner cette mémoire.
• 𝐶𝑆 = 𝑉𝑀𝐴 ∗ 𝐴15 ∗ 𝐴14 ∗ 𝐴13 ∗ 𝐴12
• 𝐶𝑆 = 1 ↔ 𝑉𝑀𝐴 = 1 𝑒𝑡 𝐴15 = 𝐴14 = 𝐴12 = 0 𝑒𝑡 𝐴13 = 1.
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Exercice 3
• Donner la plage d’adresse (en Héxadécimal) utilisée par cette
mémoire.
• Adresse début :
0010 0000 0000 0000 = (2000)16
• Adresse fin :
0010 1111 1111 1111 = (2FFF)16
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Exercice 3
• On veut augmenter la taille de la donnée à 16bits en associant
plusieurs mémoire 4K*4, donner le branchement necessaires.
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Exercice 4
• Soit un circuit défini par le fonctionnement et le schéma bloc suivant :
• Fonctionnement Schéma
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Exercice 4
• ]Réaliser le circuit C permettant de donner (J0, K0) et (J1, K1).
• Table d’excitation :
A
𝑸𝟎
Q1 Q0 X 𝑸A
𝟏 J1 K1 J0 K0
0 0 0 0 0 0 X 0 X
0 0 1 0 1 0 X 1 X
0 1 0 1 0 1 X X 1
0 1 1 0 1 0 X X 0
1 0 0 1 0 X 0 0 X
1 0 1 1 1 X 0 1 X
1 1 0 1 1 X 0 X 0
1 1 1 0 0 X 1 X 1
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Exercice 4
Mme TAMEN 15
Exercice 4
Mme TAMEN 16
Exercice 4
On veut réaliser le même fonctionnement en utilisant des bascules D
au lieu des bascules JK et une mémoire ROM au lieu du circuit C.
Donner la table de vérité et le nouveau schéma bloc (préciser bien les
entrées sorties). Combien de bits sont dans la ROM ?
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Exercice 4
• La table d’excitation devient : A
𝑸𝟎 = 𝑫𝟎
Q1 Q0 X 𝑸A
𝟏 = 𝑫𝟏
0 0 0 0 0
0 0 1 0 1
0 1 0 1 0
0 1 1 0 1
1 0 0 1 0
1 0 1 1 1
1 1 0 1 1
1 1 1 0 0
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Exercice 4
𝐷1 𝑄1
Q1 𝐻 𝑄1
DEC
Q0
3*8
X
𝐷0 𝑄0
𝐻 𝑄0
H
D1 D0
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Exercice 5
• Établir la table de vérité d'un additionneur complet à 2 bits.
• Table de vérité
𝑎H 𝑏H 𝑟HJ, 𝑆H 𝑟H
0 0 0 0 0
0 0 1 1 0
0 1 0 1 0
0 1 1 0 1
1 0 0 1 0
1 0 1 0 1
1 1 0 0 1
1 1 1 1 1
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Exercice 5
• Circuit ROM
DEC
ai
bi 3*8
ri-1
Si ri
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Exercice 2
• On dispose d’une machine dont le bus d’adresse est sur 16
bits et le bus de données est sur 8 bits. La mémoire de cette
machine est composée d’une RAM de 32Kilo*8 et d’une
ROM de 16Kilo´8
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Exercice 2
• Quelles sont les tailles des registres d’adresse MAR et MBR ?
Machine RAM ROM
𝑀 = 32𝐾 ∗ 8 + 16𝐾 𝑀 = 32 𝐾 ∗ 8 𝑀 = 16 𝐾 ∗ 8
𝑀 = 48𝐾 ∗ 8 = 2M 2,- ∗ 8 = 2P 2,- ∗ 8
= 2,M ∗ 8 = 2,P ∗ 8
2,M ≤ 48𝐾 ≤ 2,O
Donc : Donc :
Donc :
Taille MBR = 8 bits Taille MBR = 8 bits
Taille MBR = 8 bits
Taille MAR = 15 bits Taille MAR = 14 bits
Taille maximum = 16 bits
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Exercice 2
• Donner le schéma fonctionnel de cette RAM en utilisant des
mémoires de 32k´4bits
A14-A0 1
𝑅/𝑊
A14- A0 RAM 32K*4 RAM 32K*4
CS CS
D7-D4 MBR D3-D0
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Exercice 2
• Donner le schéma fonctionnel global (RAM+ROM), en précisant les
adresses de chaque boitier.
• Plages d’adressage :
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Exercice 2
• Les plages d’adressage :
RAM ROM
@min = 1000 0000 0000 0000 @min=0100 0000 0000 0000
=(8000)16 =(4000)16
@max=1111 1111 1111 1111 @max=0111 1111 1111 1111
=(FFFF)16 =(7FFF)16
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Exercice 2
1
𝑅/𝑊
A15 A14- A0 A14-A0 RAM
RAM
A14 32K*4 CS0
32K*4 D7
CS0
D7-D4 MBR D3-
A13
D0
A13- A0 ROM 16 K*8 D0
A0 MBR
CS1
MAR
D7 - D0
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Exercice 2
• On considère une machine avec la configuration suivante : une
mémoire centrale de taille 2 MØ, avec des mots mémoires de 4
octets et un bus d’adresse de taille 20bits.
• Quel est le nombre minimal de lignes d’adresses pour adresser cette
mémoire centrale ?
𝑀𝑡𝑜𝑡 = 2𝑀𝑂 = 2 ∗ 2R- ∗ 2S = 2RP = 2M ∗ 2,T
𝑀 = 2,T 𝑚𝑜𝑡𝑠
• N minimum = 19.
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Exercice 6
• Déterminer la plage d’adressage de cette mémoire (adresse minimale
et adresse maximale en Hexa).
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Exercice 6
• Plages d’adressage :
𝑴é𝒎𝒐𝒊𝒓𝒆 = 𝟐𝑴𝑶 = 𝟐𝟏𝟗 𝒎𝒐𝒕𝒔
Adresse début :
• 0000 0000 0000 0000 0000= (00000)16
Adresse fin :
• 0111 1111 1111 1111 1111=(7FFFF)16
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Exercice 6
• En fait, cette mémoire est constituée de deux blocs séparés. Le
premier est une RAM de taille 1 M octets de mots de 4 octets
adressable à partir de l’adresse (00000)16 et le deuxième est une ROM
de taille 1 M octets de mots de 4 octets adressable à partir de
l’adresse (80000)16.
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Exercice 6
• Donner le schéma de la mémoire en montrant les connexions
nécessaires.
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Exercice 6
1
𝑅/𝑊
A19 A17- A0 RAM 1MO
A18 D31
CS0
A17 D31-D0
D0
A17- A0 ROM 1MO
A0 MBR
MAR CS1
D31 - D0
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Exercice 6
• Donner les plages d’adressage des différents blocs.
RAM ROM
@min=0000 0000 0000 0000 0000 =(00000)16 @min= 1000 0000 0000 0000 0000 = (80000)16
@max=0011 1111 1111 1111 1111 =(3FFFF)16 @max=1011 1111 1111 1111 1111 = (BFFFF)16
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Exercice 6
Peut-on étendre cette mémoire et de combien ?
• Oui. On peut étendre cette mémoire de 2 blocs de 1MO chacun (deux
RAM, deux ROM, une RAM et une ROM).
Mme TAMEN 35
