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Circuits Logiques et Transcodeurs

Le document présente plusieurs exercices sur la logique combinatoire. L'exercice 1 concerne la réalisation d'un décodeur BCD à 7 segments. L'exercice 2 porte sur la conception de transcodeurs binaire-gris et gris-binaire. L'exercice 3 décrit la réalisation d'un comparateur à deux bits. L'exercice 4 propose de construire un circuit logique à partir de multiplexeurs. L'exercice 5 concerne la conception d'un circuit de contrôle qualité.

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Circuits Logiques et Transcodeurs

Le document présente plusieurs exercices sur la logique combinatoire. L'exercice 1 concerne la réalisation d'un décodeur BCD à 7 segments. L'exercice 2 porte sur la conception de transcodeurs binaire-gris et gris-binaire. L'exercice 3 décrit la réalisation d'un comparateur à deux bits. L'exercice 4 propose de construire un circuit logique à partir de multiplexeurs. L'exercice 5 concerne la conception d'un circuit de contrôle qualité.

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Série 3 corrigée

Mme Tamen 1
Exercice 1 :
Un afficheur 7 segments fonc6onne avec 7 lampes notées
comme suit : une lampe est allumée quand elle est à ‘1’.Nous
voulons réaliser un circuit logique, qui permet d’afficher les
chiffres décimaux du code BCD.

Mme Tamen 2
Exercice 1 :
a) Table de vérité

Mme Tamen 3
Exercice 1 :

Mme Tamen 4
Exercice 1 :

Mme Tamen 5
Exercice 1 :

Mme Tamen 6
Circuit b3 b2 b1 b0

Mme Tamen 7
Exercice 2 :

Réaliser les transcodeurs à 3 bits suivants :

a) Binaire – Gray.

b) Gray-binaire.

Mme Tamen 8
Exercice 2 :
• Binaire – Gray (3 bits)
• TV
b2 G2
Équations G1
b1

G2 = b2 G0
b0
G1 = b2 Ꚛ b1
G0 = b1 Ꚛ b0

Mme Tamen 9
Exercice 2 :
• Gray - Binaire ( 3 bits)
• TV:
On prend la même table de vérité avec inversement des entrées en
sorties et des sorties en entrées.
• Équations G2 b2

b2 = G2 G1
b1

b1 = G2 Ꚛ G1
b0
G0
b0 = (G2 Ꚛ G1) Ꚛ G0

Mme Tamen 10
Exercice 3 :
On souhaite réaliser un comparateur à deux bits. Il possède deux entrées sur
deux bits A1A0 , B1B0 et trois sor6es :
• E =1 si A1A0 = B1B0
• I=1 si A1A0 ˂ B1B0
• S=1 si A1A0 ˃ B1B0
1. Donner la table de vérité du circuit.
2. Simplifier les équa6ons logiques à l’aide des tableaux de Karnaugh.
3. Réaliser la fonc6on E à l’aide de portes NOR.
4. Réaliser la fonc6on I à l’aide de portes NAND.
5. Réaliser la fonc6on S en u6lisant un mul6plexeur 4*1 et des portes logiques.
6. Réaliser la fonc6on E à par6r d’un DEC 2*4 et d’un Mux 4*1.

Mme Tamen 11
Exercice 3 :
A1 A0 B1 B0 E I S
0 0 0 0 1 0 0
• TV 0 0 0 1 0 1 0
0 0 1 0 0 1 0
0 0 1 1 0 1 0
0 1 0 0 0 0 1
0 1 0 1 1 0 0
0 1 1 0 0 1 0
0 1 1 1 0 1 0
1 0 0 0 0 0 1
1 0 0 1 0 0 1
1 0 1 0 1 0 0
1 0 1 1 0 1 0
1 1 0 0 0 0 1
1 1 0 1 0 0 1
1 1 1 0 0 0 1
1 1 1 1 1 0 0 Tamen
Mme 12
Exercice 3 :

Mme Tamen 13
Exercice 3 :

Mme Tamen 14
Exercice 3 :

Mme Tamen 15
Exercice 3 :

E = (A1 + 𝐵1)(𝐴0 + 𝐵0)(𝐴0 + 𝐵0)(𝐴1 + 𝐵1)

E = (A1 + 𝐵1)(𝐴0 + 𝐵0)(𝐴0 + 𝐵0)(𝐴1 + 𝐵1)

E = A1 + 𝐵1 + 𝐴0 + 𝐵0 + 𝐴0 + 𝐵0 + (𝐴1 + 𝐵1)

Mme Tamen 16
Exercice 3 :

Mme Tamen 17
Exercice 3 :

𝐼 = 𝐴1𝐵1 + 𝐴1 𝐴0𝐵0 + 𝐴0𝐵1𝐵0

𝐼 = 𝐴1𝐵1 + 𝐴1 𝐴0𝐵0 + 𝐴0𝐵1𝐵0

𝐼 = 𝐴1𝐵1. 𝐴1 𝐴0𝐵0. 𝐴0𝐵1𝐵0


Mme Tamen 18
Exercice 3 :

Mme Tamen 19
Exercice 3 :
A1 A0 B1 B0 E I S
0 0 0 0 1 0 0
0 0 0 1 0 1 0 𝑒0 = 0
0 0 1 0 0 1 0
0 0 1 1 0 1 0
0 1 0 0 0 0 1
0 1 0 1 1 0 0
𝑒1 = 𝐵1 𝐵0 = (𝐵1 + 𝐵0)
0 1 1 0 0 1 0
0 1 1 1 0 1 0
1 0 0 0 0 0 1
1 0 0 1 0 0 1
𝑒2 = 𝐵1
1 0 1 0 1 0 0
1 0 1 1 0 1 0
1 1 0 0 0 0 1
1 1 0 1 0 0 1
𝑒3 = 𝐵1 + 𝐵0 = (𝐵1𝐵0)
1 1 1 0 0 0 1
1 1 1 1 1 0 0 Tamen
Mme 20
Exercice 3 :

Mme Tamen 21
Exercice 3 :
A1 A0 B1 B0 E I S
0 0 0 0 1 0 0
0 0 0 1 0 1 0 𝑒0 = 𝐵1 𝐵0
0 0 1 0 0 1 0
0 0 1 1 0 1 0
0 1 0 0 0 0 1
0 1 0 1 1 0 0
𝑒1 = 𝐵1𝐵0
0 1 1 0 0 1 0
0 1 1 1 0 1 0
1 0 0 0 0 0 1
1 0 0 1 0 0 1
𝑒2 = 𝐵1𝐵0
1 0 1 0 1 0 0
1 0 1 1 0 1 0
1 1 0 0 0 0 1
1 1 0 1 0 0 1
𝑒3 = 𝐵1𝐵0
1 1 1 0 0 0 1
1 1 1 1 1 0 0 Tamen
Mme 22
Exercice 3 :

y0 e0

DEC y1 e1 MUX

B1
E
4*1
2*4 y2 e2
B0 y3 e3

A1 A0

Mme Tamen 23
Exercice 4 :
Soit le montage de la figure ci-dessous, réalisé à partir de trois
multiplexeurs MUX-1, MUX- 2 et MUX-3 chacun à 4 entrées.

Z1
[Link] l’expression logique de
Z en fonction de A, B, C, D et E.
2.Réaliser le circuit de Z avec des
portes OU exclusifs.
3. On veut réduire le nombre de
MUXs à un seul MUX 8*1,
Z réaliser le circuit correspondant,
2 on peut utiliser des portes logiques
si possible.

Mme Tamen 24
Exercice 4 :

Mme Tamen 25
Exercice 4 :

E D C B A

Mme Tamen 26
Exercice 4 :

𝑍 = (𝐸(𝐷 𝐶)̅ + 𝐸𝐷 ̅
5 𝐶)(𝐵 ⊕ 𝐴)
7 + 𝐶) + 𝐸𝐷
𝑍 = (𝐸(𝐷 5 𝐶)(𝐵
̅ ⊕ 𝐴)

𝑍 = (𝐸 𝐷 7 𝐶̅ + 𝐸𝐷𝐶 + 𝐸 𝐷
7 𝐶 + 𝐸𝐷 7 𝐶 + 𝐸𝐷 ̅
5 𝐶)(𝐵 ⊕ 𝐴)
101 100 111 101 010

Mme Tamen 27
Exercice 4 :
0 e0

0 e1

e2

0 e3 MUX
Z
8*1
e4

e5

0 e6

e7

B A
E D C

101 ≡ 𝑒5 100 ≡ 𝑒4 111 ≡ 𝑒7 010 ≡ 𝑒2

Mme Tamen 28
Exercice 5 :
• On désire réaliser le circuit qui contrôle la qualité des briques dans une usine. On
effectue un contrôle de qualité selon quatre critères, le poids A et 3 dimensions
(la longueur B, la largeur C et la hauteur D).
• En adoptant la logique : 0 pour incorrect et 1 pour correct, on peut classer les
briques en trois catégories :

• Qualité X : le poids A et deux dimensions au moins sont corrects.

• Qualité Y : - le poids A seul est incorrect.


- le poids A étant correct, deux dimensions au moins sont incorrectes.

• Qualité Z : le poids est incorrect, une ou plusieurs dimensions sont incorrectes.

Mme Tamen 29
Exercice 5 :
1. Dresser la table de vérité du circuit (A est la variable de poids fort).
2. Donner les expressions simplifiées de X, Y, et Z à l’aide de tableaux
de karnaugh.
3. Tracer le circuit de X avec uniquement des portes NANDs.
4. Tracer le circuit deZ avec uniquement des portes NORs.
5. Réaliser Y avec un DEC3*8 et des portes logiques.
6. Réaliser Y avec un minimum de MUX 4*1.

Mme Tamen 30
Exercice 5 :
TV A B C D X Y Z
0 0 0 0 0 0 1 Y0
0 0 0 1 0 0 1
0 0 1 0 0 0 1
0 0 1 1 0 0 1
0 1 0 0 0 0 1
0 1 0 1 0 0 1
0 1 1 0 0 0 1
0 1 1 1 0 1 0
1 0 0 0 0 1 0 Y1
1 0 0 1 0 1 0
1 0 1 0 0 1 0
1 0 1 1 1 0 0
1 1 0 0 0 1 0
1 1 0 1 1 0 0
1 1 1 0 1 0 0
1 1 1 1 Mme Tamen 1 0 0 31
Exercice 5 :

AB 00 01 11 10 AB 00 01 11 10 AB 00 01 11 10
CD CD CD

00 00 1 1 00 1 1
01 1 01 1 01 1 1
11 1 1 11 1 11 1
10 1 10 1 10 1 1

= + + = + + + = + +
= + + = + + = + +

Mme Tamen 32
Exercice 5 :
𝑋 = 𝐴𝐵𝐶 + 𝐴𝐵𝐷 + 𝐴𝐶𝐷

𝑋 = 𝐴𝐵𝐶 + 𝐴𝐵𝐷 + 𝐴𝐶𝐷

𝑋 = 𝐴𝐵𝐶. 𝐴𝐵𝐷. 𝐴𝐶𝐷

Mme Tamen 33
Exercice 5 :

AB 00 01 11 10
CD

00 1 1 0 0
01 1 1 0 0
11 1 0 0 0
10 1 1 0 0

𝑍 = 𝐴(̅ 𝐵5 + 𝐶̅ + 𝐷
7)

𝑍 = 𝐴 + (𝐵5 + 𝐶̅ + 𝐷
7)
Mme Tamen 34
Exercice 5 :
TV A B C D X Y Z
0 0 0 0 0 0 1 Y0
0 0 0 1 0 0 1
0 0 1 0 0 0 1
0 0 1 1 0 0 1
0 1 0 0 0 0 1
0 1 0 1 0 0 1
0 1 1 0 0 0 1
0 1 1 1 0 1 0
1 0 0 0 0 1 0 Y1
1 0 0 1 0 1 0
1 0 1 0 0 1 0
1 0 1 1 1 0 0
1 1 0 0 0 1 0
1 1 0 1 1 0 0
1 1 1 0 1 0 0
1 1 1 1 Mme Tamen 1 0 0 35
Exercice 5 :
̅
Y = 𝐴𝑌0 + 𝐴𝑌1

o0
Y1
o1
Y
B o2
DEC o3
C
3*8
o4
D
o5
o6 Y0
o7

Mme Tamen 36
Exercice 5 :
TV A B C D X Y Z
0 0 0 0 0 0 1 Y0
0 0 0 1 0 0 1
Y0 = 0 0 0 1 0 0 0 1
0 0 1 1 0 0 1
Y1 = CD 0 1 0 0
Y1
0 0 1
0 1 0 1 0 0 1

Y2 = 𝐶̅ + 𝐷
7 0 1 1 0 0 0 1
0 1 1 1 0 1 0
Y2
𝑌3 = 𝐶̅ 𝐷
7 1 0 0 0 0 1 0
1 0 0 1 0 1 0
1 0 1 0 0 1 0
1 0 1 1 1 0 0
Y3
1 1 0 0 0 1 0
1 1 0 1 1 0 0
1 1 1 0 1 0 0
1 1 1 1 Mme Tamen 1 0 0 37
Exercice 5 :

0 e0
e1
0 MUX
e2
0 4*1 0
e3 e0
1
e1 Y
C D e2 MUX
e3 4*1
1 e0
0 e1 MUX
e2 A B
0 4*1
e3
0
C D

Mme Tamen 38
Exercice 6 :
On désire réaliser un circuit qui permet d’éviter le blocage des roues d’une voiture pendant
le freinage. Pour cela, on a besoin de la vitesse de chacune des roues avant. Elle est codée
sur 4 bits comme suit :
• A, B : pour la vitesse de la roue gauche ;
• C, D : pour la vitesse de la roue droite.
Le circuit à étudier génère deux sor6es de freinage Fg pour la roue gauche et Fd pour la
roue droite selon le fonc6onnement suivant :
✓ Si la vitesse des deux roues est la même, les deux sor6es Fg et Fd sont à 0.
✓ Si la vitesse de la roue gauche est supérieure à celle de la roue droite, on freine la
roue gauche (Fg = 1 ; Fd = 0).
✓ Si la vitesse de la roue gauche est inférieure à celle de la roue droite, on freine la
roue droite (Fg = 0 ; Fd = 1).

Mme Tamen 39
Exercice 6 :

1. Etablir la table de vérité.


2. Par la méthode de Karnaugh, donner les fonc6ons disjonc6ves
simplifiées de Fg et Fd.
3. Réaliser le circuit de Fg à l’aide de portes NAND uniquement.
4. Réaliser Fg avec un DEC 3*8 et des portes
5. Réaliser Fd à l’aide de MUX 4*1.

Mme Tamen 40
Exercice 6 :
A B C D Fg Fd
TV
0 0 0 0 0 0
0 0 0 1 0 1
0 0 1 0 0 1
0 0 1 1 0 1
0 1 0 0 1 0
0 1 0 1 0 0
0 1 1 0 0 1
0 1 1 1 0 1
1 0 0 0 1 0
1 0 0 1 1 0
1 0 1 0 0 0
1 0 1 1 0 1
1 1 0 0 1 0
1 1 0 1 1 0
1 1 1 0 1 0
1 1 1 1
Mme 0
Tamen 0 41
Exercice 6 :
AB 00 01 11 10 AB 00 01 11 10
CD
CD
00
00 1 1 1 01 1
01 1 1 11 1 1 1
11
10 1 1
10 1

̅ + 𝐴̅ 𝐵𝐷
𝐹𝑑 = 𝐴𝐶 5 + 𝐵𝐶𝐷
5
= + +
̅ + 𝐵𝐷(
𝐹𝑑 = 𝐴𝐶 5 𝐴̅ + 𝐶)
= + ( + )

Mme Tamen 42
Exercice 6 :

Mme Tamen 43
Exercice 6 :
A B C D Fg Fd
TV
0 0 0 0 0 0
0 0 0 1 0 1 Fg0
0 0 1 0 0 1
0 0 1 1 0 1
0 1 0 0 1 0
0 1 0 1 0 0
0 1 1 0 0 1
0 1 1 1 0 1
1 0 0 0 1 0
1 0 0 1 1 0
1 0 1 0 0 0 Fg1
1 0 1 1 0 1
1 1 0 0 1 0
1 1 0 1 1 0
1 1 1 0 1 0
1 1 1 1
Mme 0
Tamen 0 44
Exercice 6 :

o0
Fg1
o1
Fg
B o2
DEC o3
C
3*8
o4
D
o5
Fg0
o6
o7

Mme Tamen 45
Exercice 6 :
A B C D Fg Fd
TV Fd0
0 0 0 0 0 0
0 0 0 1 0 1
0 0 1 0 0 1
0 0 1 1 0 1
Fd1
0 1 0 0 1 0
0 1 0 1 0 0
0 1 1 0 0 1
0 1 1 1 0 1
1 0 0 0 1 0
Fd2
1 0 0 1 1 0
1 0 1 0 0 0
1 0 1 1 0 1
Fd3
1 1 0 0 1 0
1 1 0 1 1 0
1 1 1 0 1 0
1 1 1 1
Mme 0
Tamen 0 46
Exercice 6 :
e0
0
1 e1 MUX
1 e2
4*1

1
e3

C D

0 e0
e0
0 e1 MUX Fd
1 4*1 e1 MUX
e2
4*1
1 e2
e3
e3
0
C D
A B
e0
0
0 e1 MUX
0 e2 4*1

1 e3

C D

Mme Tamen 47

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