Universidad Surcolombiana ELECTRONICA DIGITAL I
Pre-Informe Practica de laboratorio #6
Uso de registros para desplazar, almacenar y
visualizar dos dígitos decimales
Ingeniería Electrónica
Electrónica Digital
Universidad Surcolombiana
Neiva, Huila
22/11/2024
Daniel Felipe Garrido – 20221205414 Cristhian Fernando Gutiérrez – 20221206155
I. Tabla de verdad Para el caso A, las salidas del codificador se
muestran en su estado inicial en bajo, lo cual es 1.
Salidas del Registro 0 Registro 1 Lo contrario sucede con los registros ya que su
decodificador
estado inicial en alto es 0.
Entradas
A A A A Q Q Q Q Q Q Q Q
Casos
3 2 1 0 3 2 1 0 3 2 1 0
Para el caso B, la salida del codificador muestra el
A Ninguna 1 1 1 1 0 0 0 0 0 0 0 0
Activa 4 en código BCD complementado, indicando que
B 4 1 0 1 1 1 0 1 1 0 0 0 0 fue activado. El registro 0 adquiere el valor del
(Activa)
código dado por el codificador, pero el registro 1,
C 4
(Inactiva
1 1 1 1 1 0 1 1 0 0 0 0
aun sigue en su estado inicial.
)
D 6 1 0 0 1 1 0 0 1 1 0 1 1
(Activa) Para el caso C, a pesar de que la salida del
E 6 1 1 1 1 1 0 0 1 1 0 1 1 codificador vuelve a su estado inicial, el registro 0
(Inactiva
) aun conserva el numero anterior dado, lo mismo
ocurre con el registro 1.
Tabla 1. Tabla de verdad. II. Calculo Resistencias
Salidas del Registro 0 Registro 1 a) Resistencias de entrada o de
decodificador
interruptores (Rin):
Entradas
A A A A Q Q Q Q Q Q Q Q
Casos
3 2 1 0 3 2 1 0 3 2 1 0
A Ninguna 2 2 2 2, 0 0 0 0, 0, 0 0, 0
Activa , , , 4 , , , 4 4 , 4 ,
4 4 4 4 4 4 4 4
B 4 2 0 2 2, 2 0 2 2, 0, 0 0, 0
(Activa) , , , 4 , , , 4 4 , 4 ,
4 4 4 4 4 4 4 4
C 4 2 2 2 2, 2 0 2 2, 0, 0 0, 0
(Inactiva , , , 4 , , , 4 4 , 4 ,
) 4 4 4 4 4 4 4 4
D 6 2 0 0 2, 2 0 0 2, 2, 0 2, 2
(Activa) , , , 4 , , , 4 4 , 4 ,
4 4 4 4 4 4 4 4
E 6 2 2 2 2, 2 0 0 2, 2, 0 2, 2
(Inactiva , , , 4 , , , 4 4 , 4 ,
) 4 4 4 4 4 4 4 4
Figura 1. Resistencia de entrada.
Tabla 2. Tabla de tensiones.
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Para calcular el valor de estas 𝑃𝑅𝑜𝑢𝑡 = 24𝑚𝐴 2 ∗ 75Ω = 43.2𝑚𝑊
resistencias y su potencia, se utiliza las Ecuación (8)
siguientes formulas:
Donde ‘VCC’ es el voltaje de
𝑉𝐶𝐶 − 𝑉𝐼𝐻 alimentación de las compuertas,
𝑅𝑖𝑛 =
𝐼𝐼𝐻 ‘VLED’ es el voltaje de
funcionamiento de un segmento led
Ecuación (1)
del display, ‘VOL’ es el voltaje que
5𝑣 − 2𝑣
𝑅𝑖𝑛 = = 75𝑘Ω suministra la compuerta en estado
40µ𝐴
bajo, e ‘IOL’ es la corriente máxima
→ 82𝑘Ω 𝐶𝑜𝑚𝑒𝑟𝑐𝑖𝑎𝑙 que suministra la compuerta en
Ecuación (2)
estado bajo.
𝑃𝑅𝑖𝑛 = 𝐼𝐼𝐻 2 ∗ 𝑅𝑖𝑛
Ecuación (3)
𝑃𝑅𝑖𝑛 = 40µ𝐴 2 ∗ 82𝑘Ω = 131.2µ𝑊 c) Resistencias de entrada de
Ecuación (4) controladores para decodificador
(Rcont.):
Donde ‘Vcc’ es el voltaje de
alimentación de la compuerta, ‘VIH’
es el voltaje de entrada mínimo que
la compuerta reconoce como uno (1)
lógico, e ‘IIH’ es la corriente de
entrada máxima de funcionamiento
de la compuerta.
b) Resistencias de salida (Rout):
Figura 3. Resistencia de entrada de controladores para
decodificador.
Para calcular el valor de estas
resistencias y su potencia, se utiliza las
siguientes formulas:
𝑉𝐶𝐶 − 𝑉𝐼𝐻
𝑅𝑐𝑜𝑛𝑡 =
𝐼𝐼𝐻
Ecuación (9)
5𝑣 − 2𝑣
Figura 2. Resistencia de salida.
𝑅𝑐𝑜𝑛𝑡 = = 150𝑘Ω
20µ𝐴
Ecuación (10)
Para calcular el valor de estas
resistencias y su potencia, se utiliza 𝑃𝑅𝑐𝑜𝑛𝑡 = 𝐼𝐼𝐻 2 ∗ 𝑅𝑖𝑛
las siguientes formula: Ecuación (11)
𝑉𝐶𝐶 − 𝑉𝐿𝐸𝐷 − 𝑉𝑂𝐿 𝑃𝑅𝑐𝑜𝑛𝑡 = 20µ𝐴 2 ∗ 150𝑘Ω = 60𝑚𝑊
𝑅𝑜𝑢𝑡 = Ecuación (12)
𝐼𝑂𝐿
Ecuación (5) Donde ‘Vcc’ es el voltaje de
5𝑣 − 2.8𝑣 − 0.5𝑣 alimentación de la compuerta, ‘VIH’
𝑅𝑜𝑢𝑡 = = 70.83Ω es el voltaje de entrada mínimo que
24𝑚𝐴
→ 75Ω 𝐶𝑜𝑚𝑒𝑟𝑐𝑖𝑎𝑙 la compuerta reconoce como uno (1)
Ecuación (6) lógico, e ‘IIH’ es la corriente de
𝑃𝑅𝑜𝑢𝑡 = 𝐼𝑂𝐿 2 ∗ 𝑅𝑜𝑢𝑡 entrada máxima de funcionamiento
Ecuación (7) de la compuerta.
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Rin Rout Rcont
Valor de 82𝑘Ω 75Ω 150𝑘Ω
resistencias
Valor de 131.2µ𝑊 43.2𝑚𝑊 60𝑚𝑊
potencias
Tabla 3. Tabla de valores de resistencias y potencias.
III. Calculo Temporizador
Para el circuito integrado LM556 el rango
de valores es:
Figura 5. Diagrama de bloques del circuito
conversor
1. Entrada de Dígitos por teclado: En
IV. Lógica Adicional esta etapa se selecciona mediante
teclado o switch el numero decimal
requerido.
2. Conversión Decimal a BCD:
Mediante codificador 74LS148 se
realiza la conversión de código
descrita.
3. Lógica adicional: Esta lógica usando
Figura 4. Lógica Adicional para el sumador conversor compuertas AND produce una salida
de código. para la posterior activación del
temporizador monoestable.
RCLK Salidas codificador TRG 4. Temporización Monoestable: El
1 D C B A
0 1 1 1 1 1
temporizador 556 está programado
1 1 1 1 1 0 como un estado monoestable para
1 1 1 1 0 0 que active el flanco de subida de los
1 1 1 0 1 0
1 1 1 0 0 0 registros, en resumen, cada vez que la
1 1 0 1 1 0 lógica adicional pase a un estado
1 1 0 1 0 0
1 1 0 0 1 0
bajo, su salida estará en un estado
1 1 0 0 0 0 inconstante (ALTO).
1 0 1 1 1 0 5. Etapa de Registros: En esta etapa se
1 0 1 1 0 0
Tabla 4. Tabla de verdad de logia adicional. encuentran 2 registros en los cuales el
primero almacena el BCD y el
segundo es con el que se producirá el
traslado del digito cuando se
disponga un segundo número.
V. Diagrama de bloques
6. Temporización Astable: El 556 es un
temporizador astable, el cual a la
salida genera una señal cuadrada de
200 Hz, siendo este el valor requerido
para la activación del multiplexor y
poder seguir realizando registros.
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7. Etapa de Multiplexor: En esta etapa 9. Etapa de Visualización: En esta etapa
se seleccionan las salidas del registro se encuentra dos display ánodo
que se mostraran. común de 7 segmentos, el LSB será
8. Etapa Decodificadora: En esta etapa el número que se ingresa por primera
se encontrará un decodificador vez o que se encuentra en el primer
manejador de display, el cual posee registro, y el MSB será el número del
entradas de 4 Bits, pero solo mostrara segundo registro el cual se encuentra
números BCD que es lo necesario desplazado.
para este circuito.
VI. Diseño circuital lógico completo
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Figura 6. Diseño del circuito lógico completo.
