Tecnicas Digitales I
Universidad
TRABAJO PRÁCTICO Nro. 8 Nacional
Latchs y Flip Flops de Moreno
1) Dado el siguiente circuito:
74LS75/4
74LS08/4
E D Q salida
reloj
LE
Y las siguientes señales:
Reloj
Se pide:
a) Construir un gráfico con la forma de onda en la salida.
b) El funcionamiento del circuito es que la señal E es una habilitación que dejar pasar o no el reloj a la
salida . Sin embargo, la habilitación presenta una característica particular. Explicar esta
característica .
c) Indica cual es la máxima frecuencia de la señal de reloj .
d) Indicar cual es el tiempo de demora del circuito .
2) a) Implementar utilizando un multiplexor 74HC157, 4 latchs D . Los mismos deben tener una señal de LE
común a todos los dispositivos.
b) Dar el tiempo de conmutación de los latch D implementados.
c) Dar la Inmunidad al Ruido (NI) para los latchs con tensiones de alimentación de 2V; 3,3V 5V y 6V.
3) Dado un flip flop disparado por flanco del tipo que se indica , agregarle las compuertas adicionales
exteriores necesarias para que se transforme en un flip-flop del otro tipo indicado.
a) Con un FF D , construir un FF T ( Usar para el diseño un 74LS174 y lógica adicional real )
b) Con un FF JK , construir un FF D ( Usar para el diseño un 74LS112 y lógica adicional real )
4) Se desea realizar, usando como base un flip flop T ( 74 LS 112 ), un circuito de 3 entradas: una que
responda como un FF T, otra como un D y la señas de control M tal que, cuando M sea 0, el dispositivo se
comporte como un flip flop T controlado por la entrada correspondiente, mientras que si M es 1, se
comportará como un D controlado por la entrada respectiva.
a) Implementar el circuito con dispositivos reales .
b) Realizar la descripción en VHDL.
5) En el circuito de la figura todas las entradas, las entradas A; B; y C en el comienzo de la operación están
en estado BAJO. Se supone que la salida Y debe cambiar a ALTO solo cuando A; B y C cambian en
cierta secuencia. Se pide:
a) Determine la secuencia en que Y cambiará a ALTO.
b) Explique porque el circuito requiere pulso de inicio.
c) Modifique el circuito para que se utilicen FF D.
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6) Dar la forma de onda de salida, cuando son atacados por las señales que más abajo se dan, de:
a) un flip flop JK amo-esclavo (generar las salidas Qamo y Qesclavo)
b) un flip flop JK disparado por flanco negativo
7) Dar la forma de onda de salida, cuando son atacados por las señales que más abajo se dan, de:
a) un latch D
b) un flip flop D disparado por flanco positivo de reloj
c) realizar la descripción de ambos casos en VHDL.
LE/CLK
8) El producto final de una fabricación son barras metálicas cuya longitud ha de ser inferior o
igual a L. Para hacer la selección del producto terminado se utiliza el sistema mostrado en la
siguiente figura:
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Está constituido por una cinta transportadora que hace pasar las barras entre dos detectores
fotoeléctricos separados por una distancia L y constituidos por un emisor y un receptor de
luz. La salida de los receptores adopta dos niveles de tensión diferenciados según esté o no
una barra situada entre él y su emisor respectivo. Se asigna por convenio el estado lógico 1 a
la salida cuando la barra está situada delante del detector y el estado 0 en el caso contrario.
Después del segundo detector existe una pequeña puerta trampa ( trampilla ) accionada por un motor M. Si
la barra tiene una longitud mayor que L, se ha de excitar M y abrir la puerta para dejar caer la barra; en caso
contrario no ha de excitarse M. Una vez comprobada la barra, el motor M ha de volver a des excitarse y el
sistema quedará preparado para una nueva detección.
Se pide diseñar un sistema secuencial asíncrono cuyas entradas sean las salidas de los
detectores, que denominaremos x1 y x2, y cuya salida z accione el motor M al ponerse en
estado 1. Suponer que la distancia que separa dos barras sometidas a verificación es tal
que nunca podrá entrar una en la zona de detección mientras se está comprobando la anterior.
9) Diseñar un multivibrador astable apto para trabajar como generador de una señal cuadrada de ciclo de
actividad del 50 % de frecuencias de 1KHz, 10 KHz y 25KHz, utilizando Disparadores Schmidt; MC14106 y
componentes pasivos. La tensión de alimentación es de 10 V.
B) Dibujar las señal de salida del circuito anterior.
C) Repetir el punto a y b para tensiones de alimentación de 5V y 15V
10) El circuito de la figura muestra 3 multivibradores monoestables no redisparables conectados en cascada
de sincronización que producen 3 pulsos de salida (Q3) secuenciales. Observe el ‘1’ frente del pulso
en cada símbolo de monoestable para indicar que la operación del mismo es no redisparable.
A) Dibuje un diagrama de tiempos que muestre la relación entre los pulsos de entrada y salida de
los 3 monoestables. Suponga una duración del pulso de entrada de 10 ms.
B) De el circuito del 1er. Monoestable no redisparable utilizando un MC14106.
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11) Un multivibrador monoestable redisparable puede utilizarse como detector de frecuencia de pulso que
detecte cuando la frecuencia de un pulso de entrada este por debajo de un valor predeterminado. En
el circuito de la figura se muestra un ejemplo simple de esta aplicación. La operación comienza con el
cierre del interruptor SW1.
A) Describa como responde el circuito a las frecuencias de entrada por encima de 1 KHz.
B) Describa como responde el circuito a las frecuencias de entrada por debajo de 1 KHz.
C) ¿Como modificaría el circuito para mostrar cuando la frecuencia de entrada cae por debajo de 50
KHz?.
OPTATIVOS:
1) Una empresa fabricante de circuitos integrados ofrece comercialmente un denominado latch
direccionable de 8 bits, que consiste básicamente en un conjunto de 8 latches con sus respectivas
salidas disponibles como terminales del integrado, al igual que su entrada D común a todos ellos. Tres
líneas de selección determinan, en presencia de la única señal de habilitación del latch que posee el
integrado, cual de los 8 latches resulta habilitado.
Se pide:
a) dibujar el circuito interno a nivel de compuertas circuitos lógicos conocidos (decodificadores,
latches, etc.) .
b) justificar o no la pretensión del fabricante que lo promueve para ser utilizado como demultiplexor
con retención.
c)
2) Dado un flip flop disparado por flanco del tipo que se indica , agregarle las compuertas adicionales
exteriores necesarias para que se transforme en un flip-flop del otro tipo indicado
a) T en D ( Usar para el diseño un 74LS112 y lógica adicional real )
b) D en JK (Usar para el diseño un 74LS174 y logica adicional real)
3) Determinar la forma de onda de la salida Q de un latch S-R (construido con compuertas NAND) si se
aplican las formas de onda de la figura a sus entradas. Suponer que inicialmente Q, la señal que debe
dibujar, está a nivel BAJO.
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4) En un sistema de formación de piezas plasticas por rotomoldeo se tienen dos motores: Uno que funciona
directamente haciendo rotar el molde y otro (el que se quiere automatizar) en el eje trasversal, que hace
oscilar el molde desde 0 a 180 grados. Para detectar la posición 0 o 180 se tienen dos sensores inductivos
quienes realizaran la inversion de marcha cada vez que el molde pasa por esa posición. La inversion de
marcha se realiza activando un contactor (giro izquierda)y desactivando el otro (giro derecha), y viceversa.
Implementar un sistema capaz de, automáticamente, invertir el sentido de giro del motor cada vez que el
molde pasa por uno de los sensores.
5) Diseñar un circuito que controle el motor de la barrera de salida de un estacionamiento. La misma se
debe abrir cuando el conductor del automóvil presiona el pulsador y se debe cerrar cuando el sensor en el
piso detecta que el vehículo ya terminó de pasar.
a) Diseñar con Latch y FF
b) Realizar una descripción en VHDL que cumpla con lo solicitado.
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Suponer:
Pulsador presionado entrega
GND.
Sensor sin detección entrega
GND.
Barrera baja = 0, Barrera alta = 1.
6) Una vía férrea posee dos carriles independientes, excepto en un tramo. Se desea diseñar un
autómata asincrónico que actúe sobre los dos semáforos y controle el paso de los trenes en
ambas direcciones, según el diagrama de vías que se encuentra mas adelante. Para ello se coloca
un detector en cada vía antes del semáforo correspondiente (D1 y D3) y otro después de la zona
común (D2 y D4). La operación del autómata debe ser así:
Al activar el sistema el autómata se pone en estado inicial en el cual R1 = R2 = ‘1’ y V1 = V2 = ‘0’. En
este estado el autómata observa si viene un tren por la vía 1 o la vía 2 lo cual es indicado
respectivamente por la subida a “UNO” de x1↑ o de x3↑. La subida a “UNO” de x1↑ hace que el semáforo
se ponga en verde (V1 = ‘1’ y R1 = ‘0’) y la subida a “UNO” de x 2↑ realiza la misma acción sobre el
semáforo 2 (V2 = ‘1’ y R2 = ‘0’).
Si es x1 la variable de entrada que ha subido al estado “UNO”, lo cual quiere decir que hay un tren en la
zona común procedente de la vía 1, el autómata espera que la cola del tren pase por delante de D2 y
esto hace que x2↓ pase de “UNO” a “CERO ” y pueden existir 2 situaciones:
A) Si mientras el tren en la vía 1 se encuentra en la zona común llega el tren 2, que se detiene ante
su semáforo, la variable x3 se encontrará en estado “UNO”.
B) Si no ha llegado ningún tren por la vía 2, la variable X 3 se encontrará en estado “CERO”.
.
En el caso A, al cambiar, x2, el autómata debe activar V2 y desactivar R2 para dejar pasar al tren
correspondiente. Esto quiere decir que el autómata tiene que pasar al mismo estado que cuando paso a
“UNO” x3↑ partiendo de las condiciones iniciales.
En el caso B el autómata volverá a las condiciones iniciales. De forma parecida, cuando el tren
procedente de la vía 2 abandona la zona común, se pueden tener dos situaciones similares indicadas por
x4 y x1.
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Diagrama de flujo del funcionamiento del autómata.
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