UNIVERSIDAD TÉCNICA DE AMBATO
FACULTAD DE INGENIERÍA EN SISTEMAS, ELECTRÓNICA E INDUSTRIAL
CARRERA DE TELECOMUNICACIONES
PERÍODO ACADÉMICO: octubre 2021 - febrero 2022
Cdla. Universitaria (Predios Huachi) / Casilla 334 / Telefax: 03-2851894 – 2411537, Correo Electrónico: [Link]@[Link]
AMBATO-ECUADOR
PRÁCTICA 4
I. PORTADA
UNIVERSIDAD TÉCNICA DE AMBATO
Facultad de Ingeniería en Sistemas, Electrónica e Industrial
“Práctica N° 4”
Tema: Diseño Secuencial 1
Carrera: Telecomunicaciones
Unidad de Organización Curricular: Profesional
Línea de Investigación: Nanotecnología
Ciclo Académico y Paralelo: Cuarto “A”
Alumno: Sebastián Fiallos
Módulo y Docente: Sistemas Digitales Ing. Carlos Gordon
II. 1. PP
INFORME DE LA PRACTICA N°4
2. YY
Título.
Diseño Secuencial 1
2.2 Objetivos.
Objetivo general.
Elaborar un circuito de un comparador MOD 8 que vaya de forma
ascendente y descendente.
.
Objetivos específicos.
Diseñar los diagramas de estado del MOD 8 y verificar las salidas de los
flip-flop.
Simular el contador MOD 8 tipo JK y D en el software Proteus
Profesional.
Implementar dicha simulación en la Protoboard solamente del tipo JK
2.3 Resumen.
Al enviar una cadena con una determinada cantidad de bits de información por
un medio de transmisión, siempre existe el riesgo de que alguno de esos bits
se ve afectado por influencias externas, tales como voltajes residuales o
Campos magnéticos provocados por el flujo de la corriente, cada bit de
información tiene dos posibles valores, los Cuáles pueden ser High y low. Estos
valores fácilmente pueden ser alterados por dichos factores externos, es por
esta razón Qué es necesario un sistema que permite encontrar estos errores y
corregirlos.
En este informe se profundizará en estos códigos de control, detección y
corrección de errores de bits de información. Desde el bit de paridad, qué nos
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permite encontrar un único error dentro de una cadena de bits hasta la
codificación hamming, qué nos permite no solo detectar el error sino también
corregirlo de una forma muy sencilla.
2.4 Palabras clave.
Ascendente, descendente, diagramas, mapas k.
2.5 Introducción.
Muchos sistemas emplean un bit de paridad como medio para la detección de
errores de bit. Cualquier grupo de bits contiene un número par o impar de 1s.
Un bit de paridad se añade al grupo de bits para hacer que el número total de
1s en el grupo sea siempre par o impar. Un bit de paridad par hace que el
número total de 1s sea par, y un bit de paridad impar hace que el número total
de 1s del grupo sea impar. [1]
Un determinado sistema puede funcionar con paridad par o impar, pero no con
ambas. Por ejemplo, si un sistema trabaja con paridad par, una comprobación
que se realice en cada grupo de bits recibidos tiene que asegurar que el
número total de 1s en ese grupo es par. Si hay un número impar de 1s, quiere
decir que se ha producido un error. [2]
2.6 Materiales y Metodología.
Materiales virtuales.
2 integrados 74376
Integrado 7404
Integrado 7408
Integrado 7486
Integrado 7432
Integrado 7447
2.1.1 Metodología
1. Realizar los diagramas de estados.
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2. Números F-F
3. Realizar las tablas de salida.
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4. Realizar los mapas k.
5. Simular el circuito de forma ascendente (múltiplos de 4)
6. Simular el circuito de forma descendente (serie de fibonacci)
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2.7 Resultados y Discusión
Códigos detectores de error consiste en incluir en los datos transmitidos, una
cantidad de bits redundantes de forma que permita al receptor detectar que se
ha producido un error, pero no qué tipo de error ni dónde, de forma que tiene
que solicitar retransmisión.
Códigos correctores de error consiste en la misma filosofía que el anterior,
incluir información redundante pero en este caso, la suficiente como para
permitirle al receptor deducir cual fue el carácter que se transmitió, por lo tanto,
el receptor tiene capacidad para corregir un número limitado de errores.
2.8 Conclusiones.
El bit de paridad solo permite detectar un solo error.
El bit de paridad no permite corregir un bit erróneo
Se necesita un número mínimo de bits de paridad para codificar por medio
de codificación haming
Estos métodos de detección tienen un gran porcentaje de falla, ya que
pueden variar cierto número de bits los cuales no afecten a la paridad.
2.9 Recomendaciones
El decodificador puede corregir cualquier error de 16 símbolos en la palabra de
código, es decir, errores de hasta 16 bytes en cualquier lugar de la palabra
pueden ser automáticamente corregidos.
Dado un tamaño de símbolo s, la máxima longitud de la palabra de código (n)
para un código Reed-Solomon es n=.2-1Por ejemplo, la máxima longitud de un
código con símbolos de 8 bits (s=8) es de 255 bytes. Los códigos Reed-
Solomon pueden ser acortados haciendo un número de símbolos de datos
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igual a cero en el codificador, no transmitiendo estos, y reinsertando éstos en el
decodificador.
Referencias Bibliográficas
[1] T. L. Floyd, Ffundamentos de Sistemas Digitales, Madrid, 2006.
