Módem G3RUH: Transmisión de Datos por Radio
Módem G3RUH: Transmisión de Datos por Radio
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Fig. 3
El funcionamiento de este bler, situado en el receptor). CONFORMADOR DE PULSOS torsión diferente, trataremos de
esquema es el siguiente: los Ambas operaciones se realizan Necesitamos una etapa que modelarlas y contrarrestarlas con
datos que llegan desde el orde- sobre bits (datos digitales). La ale- convierta los bits a enviar en las este filtro ecualizador.
nador serán aleatorizados. El atorización consiste en sustituir señales específicas que viajarán
resultado modulará los pulsos las secuencias monótonas de por el canal. Esta es la misión del DETECCIÓN Y DECISIÓN
básicos que vamos a introducir unos y ceros, por secuencias conformador de pulsos. A su Esta parte es la más impor-
en el canal. Una vez en el recep- combinadas de 1 y 0. El receptor entrada llegan los bits y éste pro- tante en el proceso de transmi-
tor, la señal recibida será filtrada reconocerá las secuencias inter- porciona a su salida el pulso sión-recepción. Todas las consi-
y ecualizada para mejorar la cambiadas y podrá obtener los correspondiente a cada bit o a deraciones que se realizan en el
detección. El siguiente paso es bits originales (desaleatorización). cada conjunto de bits. diseño de un módem están desti-
evaluar la señal en los instantes Las consecuencias de aleatori- El conformador de pulsos debe nadas a mejorar los resultados
adecuados y decidir qué bit repre- zar los bits a transmitir son proporcionar una señal adecuada de esta fase.
senta cada pulso recibido. La varias. Por un lado se elimina la a las características del canal, es La función del bloque de detec-
determinación del instante en el componente continua que se pro- decir, que presente componentes ción es muestrear la señal de
que evaluar la señal es la función duce de forma temporal por la frecuenciales en el mismo rango entrada en el instante adecuado
del bloque denominado sincro- transmisión de secuencias monó- que la señal de voz/audio. Exis- para que la etapa de decisión
nismo. Finalmente el desaleatori- tonas. Esta componente continua ten muchas familias de pulsos pueda determinar el valor del bit
zador recuperará los datos origi- es filtrada por los equipos, provo- utilizadas para la transmisión. correspondiente al símbolo
nales. cando distorsiones en la señal. Tendremos que seleccionar la enviado de manera acertada.
A continuación entraremos a Por otro lado, facilita el trabajo que más se adapte a la situación Las distorsiones que se han
conocer un poco más cada uno realizado por el bloque denomi- en la que nos encontramos. producido en la señal, así como
de los bloques. nado sincronismo, ya que procura el ruido dentro de banda que no
que la señal presente abundan- FILTRO DE RECEPCIÓN hemos podido eliminar, provocan
CANAL tes transiciones. Como podremos A la entrada del receptor se desviaciones del valor original de
En este modelo se ha denomi- comprobar más adelante, las encuentra un filtro que elimina el la señal recibida en el instante de
nado canal al conjunto formado transiciones nos van a asegurar ruido fuera de la banda utilizada. detección. Estas desviaciones
por la emisora de radio, el medio que el bloque de sincronismo rea- Este filtro presenta un ancho de dificultan la labor del bloque de
radioeléctrico (aire) y el receptor lice su función de un modo más banda ajustado al ancho de decisión.
de radio. Este canal analógico correcto y podremos recuperar banda de la señal (6 kHz). En la figura 4 podemos obser-
presenta una limitación en ancho mejor los bits a partir de la señal var un “diagrama de ojo”. Este
de banda y además añade ruido a recibida. Además la aleatoriza- ECUALIZADOR diagrama presenta superpuestas
la señal. La entrada al canal, al ción distribuye la energía de la La función de este bloque es las señales recibidas en el emi-
igual que su salida, es una señal señal a transmitir a lo largo de la eliminar, en la medida de lo posi- sor a lo largo de varios periodos
de audio en banda base (ancho banda, evitando picos de señal ble, la distorsión en frecuencia de símbolo, de forma que pode-
de banda de 6 kHz). Los niveles en determinadas frecuencias y en introducida por el canal. Hemos mos ver cómo varía la señal en la
de tensión de dicha señal de sus armónicos. Estos picos son supuesto que el canal incluye transmisión de una secuencia de
audio serán compatibles con la debidos a que determinadas tanto el medio radio como el símbolos. En la figura se observa
entrada y salida de audio de la secuencias pueden producirse transceptor por lo que la distor- cómo, en su parte central, la
emisora. El hecho de que la emi- periódicamente, provocando com- sión introducida por la emisora señal presenta apertura máxima.
sora transmita en un canal radio ponentes importantes a las fre- está incluida en la distorsión del Este punto central es el instante
en la banda de VHF o en la de cuencias correspondientes y en canal. Ya que los distintos tipos adecuado para la detección (y
UHF, que utilice FM, AM, o SSB, sus armónicos. de emisoras introducen una dis- decidir si el dato es un 1 o un 0),
es irrelevante para nosotros (nota
2). Lo único que nos interesa es
que ese canal completo emisor-
aire-receptor presenta una deter-
minada respuesta en frecuencia,
con su ancho de banda, nivel de
ruido y distorsiones de amplitud y
fase. Nuestro módem debe trans-
mitir datos a través de dicho
canal adverso que deben detec-
tarse en el otro extremo sin erro-
res (o con tan pocos como sea
posible). Para ello, la señal que
enviemos por el canal debe estar
adecuada a él, de forma que se
minimicen los efectos nocivos de
la transmisión y esto se refleje en
una menor tasa de error en recep-
ción.
SCRAMBLER Y UNSCRAMBLER
Estos bloques se encargan de
aleatorizar los datos a enviar
(scrambler, situado en el emisor)
y de desaleatorizar la secuencia
de bits recibida, para recuperar la
información original (unscram-
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Comunicaciones Digitales
porque es el punto en el que los tiva o otra negativa). La determina- El ruido producido por estos retar- monótonas tanto de unos como
valores posibles de la señal se ción de esos instantes es el obje- dos aleatorios se denomina jitter de ceros. El método utilizado para
encuentran claramente definidos y tivo del bloque de sincronismo. o ruido de fase y es un problema evitar dichas secuencias debe ser
bien distanciados entre sí (tam- Volviendo de nuevo a la figura 4 importante en los sistemas de tal que permita recuperar los bits
bién se pueden observar otros dos podemos ver que hay instantes en telecomunicación. originales en recepción. Esta es
instantes similares, uno próximo los que la señal pasa por cero. En resumen, no conocemos los la razón principal por la que se
al extremo izquierdo y otro al dere- Estos instantes corresponden a puntos exactos de muestreo y han incluido los bloques de
cho de la gráfica, que se corres- transiciones de símbolo, es decir, debido al jitter y a las derivas de scrambler y unscrambler.
ponderán con los instantes de de un 1 a un 0 o viceversa. De los osciladores, tendremos que
decisión adecuados para el bit esta forma el intervalo entre tran- obtenerlos mediante el análisis Nota 1: Disponer de un acceso
anterior y posterior al central). La siciones indica cuánto dura el sím- de la señal recibida (que es lo directo al varactor del transmisor
etapa de decisión, una vez fijado bolo enviado. único a nuestra disposición). de FM permite utilizar desviacio-
este punto, deberá conocer el En un principio podemos pensar Muchos de los esquemas de nes de frecuencia grandes, y por
umbral que separa las zonas de que ya conocemos la duración de recuperación de sincronismo se tanto anchos de banda elevados.
tensión correspondientes a cada cada símbolo, puesto que cono- basan en la detección de esos El módem deberá estar diseñado
uno de los dos símbolos. En este cemos la frecuencia nominal del cambios de señal que nos han para consumir el ancho de banda
caso el umbral será un valor equi- módem (en este caso 9600 bps). permitido ver en la figura 4 la estrictamente necesario y legal-
distante entre símbolos. Pero ésta no suele coincidir con duración de los símbolos. Al esti- mente permitido para un único
la real. La señal sufre retardos mar el tiempo que dura el sím- canal de comunicaciones.
SINCRONISMO aleatorios debido a los medios bolo se puede muestrear la señal
Esta etapa es una de las más que atraviesa y retardos acumula- más o menos en la mitad de ese Nota 2: Realmente no va a ser
importantes ya que su correcto tivos debidos a las tolerancias de intervalo. Además, el valor del lo mismo trabajar en una banda
funcionamiento va a influir directa- los equipos (osciladores). Estos intervalo se puede actualizar en de frecuencia u otra, o utilizar
mente en la correcta recuperación retardos, aun estando dentro de cada transición y ser utilizado modulación FM, AM, etc., ya que
de los bits enviados. unos límites admitidos, pueden ir también en el muestreo de el ruido introducido en el canal
Se ha mencionado que la etapa acumulándose y provocar que no secuencias de símbolos que no tiene en cada caso característi-
de detección debe conocer los ins- muestreemos el valor de la señal presenten transiciones. Para una cas y efectos diferentes. Esto
tantes óptimos en los que evaluar en el instante adecuado. Incluso buena actualización, es conve- puede tenerse en cuenta a la hora
la señal para poder determinar puede llegar a ocurrir que la acu- niente que las secuencias de sím- de diseñar un modem optimizado
correctamente a qué bit corres- mulación de retardos supere la bolos enviados no sean monóto- para una u otra banda, utilizando
ponde su nivel (recordamos que duración de un símbolo, con la nas. Como la forma de la señal algoritmos adaptados a cada
estamos utilizando una amplitud correspondiente pérdida de un bit depende de los datos enviados, situación que minimicen la proba-
diferente para cada bit, una posi- en la secuencia recuperada (slip). necesitamos evitar secuencias bilidad de error en la recepción.
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Comunicaciones Digitales
EL MÓDEM G3RUH (II)
Borja Etxebarria, Itziar Martínez, Inma Hernáez, Ricardo Gándara
Grupo de Tratamiento de Señal y Radiocomunicaciones
E.T.S.I. Telecomunicación de Bilbao
URE (6/99) - 27
Comunicaciones Digitales
FIG. 4 FIG. 5
28 - URE (6/99)
de ambos filtros podemos con-
seguir que cumplan la condición
de oposición de fase, por lo que
cumple el criterio del filtro adap-
tado. La respuesta temporal y
frecuencial del filtro en raíz de
coseno alzado están represen-
tadas en la figura 9.
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EL MÓDEM G3RUH (III)
Borja Etxebarría, Inma Hernáez, Itziar Martínez, Ricardo Gándara, Josu Ortego.
Grupo de Tratamiento de Señal y Radiocomunicaciones E.T.S.I. Telecomunicación de Bilbao
En este artículo nos encontramos ya ante el módem tor con la mínima distorsión posible, es decir, como pulsos de Nyquist.
Así el preecualizador aplica una función inversa a la que prevemos va
hardware. Vamos a ver qué bloques del esquema a tener el canal.
general implementa y describiremos el funcionamiento El efecto inmediato de implementar el ecualizador en recepción es
del demodulador. simplificar el diseño del demodulador. Pero esta ventaja tiene una gran
contrapartida: el ecualizador será fijo, no pudiéndose adaptar a las dis-
torsiones variables de la señal en el medio. Para intentar paliar esta
MODELO DEL MÓDEM G3RUH limitación, el módem G3RUH propone varios modelos de ecualizadores
En el primer artículo de esta serie se analizaron los bloques princi- que resultan óptimos para modelos concretos de receptores.
pales que suelen encontrarse de forma general en todos los sistemas Además, el modulador implementa la conformación de pulsos en
de comunicación. coseno alzado, por lo que no va a existir interferencia entre símbolos
Tras analizar, en el segundo artículo, los problemas con los que nos en el receptor. Esto no es del todo cierto, porque ni el canal es plano,
encontramos, llegamos a un modelo ideal de comunicación que se ni existe una etapa de postecualización que se adapte a las distorsio-
puede observar en el diagrama superior de la figura 1. En la parte infe- nes variables producidas por el canal, pero si es una buena forma de
rior de la misma figura encontramos los bloques implementados por el reducir en lo posible estas interferencias.
módem G3RUH. En cuanto al demodulador, podemos observar que no implementa el
filtro adaptado a la entrada. Por esta razón,
el módem G3RUH no va a proporcionar una
relación señal a ruido óptima. El filtro se ha
suprimido por el deseo, anteriormente men-
cionado, de simplificar el demodulador.
ESQUEMA ELECTRÓNICO
En la figura 2 se presenta el esquema elec-
trónico del módem hardware. En él se pue-
den distinguir todos los bloques menciona-
dos en el esquema general del módem
G3RUH. Los tres bloques inferiores del
esquema corresponden al modulador y los
tres superiores al demodulador. Comenzando
por el modulador, el bloque verde corres-
ponde al scrambler, el rojo al conformador de
pulsos y el azul a los filtros de salida. Los blo-
ques correspondientes al demodulador son:
en naranja los filtros de entrada, en lila el
Figura 1
unscrambler y en amarillo la recuperación de
sincronismo y la detección y decisión. Ade-
En ambos esquemas se pueden distinguir el modulador, el medio de más, el bloque amarillo incluye la generación de la señal DCD (Data
transmisión y el demodulador. El modulador del esquema ideal está Carrier Detect) necesaria para validar la recepción de los datos.
compuesto por el scrambler y el conformador de pulsos (repre-
sentado en la figura por PT(f)). El medio de transmisión está
modelado por un canal a cuya salida se añade ruido. A conti-
nuación se presenta el demodulador, que incluye el filtro adap-
tado de recepción (representado por PR(f)), el ecualizador, el
detector de sincronismo, la detección y decisión y el unscram-
bler.
El modulador del módem G3RUH contiene los bloques de
scrambler y conformador de pulsos del modelo ideal y añade un
ecualizador. Tras el canal, se encuentra el demodulador que
incluye los bloques de detección y decisión, sincronismo y uns-
crambler.
Como se puede observar, el módem G3RUH no implementa el
filtro adaptado de recepción e incluye el ecualizador en el modu-
lador.
Al ecualizador, por situarse en emisión, se denomina pree-
cualizador. Su misión es predistorsionar los pulsos antes de ser
enviados de forma que, tras atravesar el canal, lleguen al recep-
Figura 2
Comunicciones Digitales
MODULADOR
El objetivo de este bloque es adaptar la señal de datos
a las características del medio utilizado de modo que su
recepción se realice en las mejores condiciones posibles.
SCRAMBLER
El scrambler es el encargado de aleatorizar la secuencia
de bits a enviar.
La necesidad de esta aleatorización se puede encontrar
en el primer artículo de esta serie y será posteriormente
analizada en el artículo dedicado a los scramblers y uns-
cramblers.
La peculiaridad de este módem es la forma de tomar la
salida del scrambler. En lugar utilizar únicamente el bit Figura 3
correspondiente al pulso que se genera en cada momento,
se tienen también en cuenta los bits que se han enviado
antes y los que se van a enviar después. Recordamos que el modula- La implementación digital más generalizada de un conformador de
dor envía una señal con interferencia entre símbolos (ISI) que, al atra- pulsos es el filtrado FIR. Se utiliza un filtro cuya respuesta impulsional
vesar el canal, llega sin ISI al receptor. El conocer los bits anteriores presente la forma del pulso deseada y se introduce como entrada la
y posteriores a la hora de enviar el bit actual nos permite elegir la ISI amplitud que representa cada bit. Así se obtiene a la salida la secuen-
adecuada que debe llevar el símbolo correspondiente para que llegue cia de pulsos a transmitir.
al receptor sin estar afectado por los símbolos adyacentes. Pero el módem G3RUH no incluye un elemento que realice un fil-
trado de la entrada, sino que lo simula mediante una memoria donde
IMPLEMENTACIÓN HARDWARE DEL SCRAMBLER se guardan formas de onda.
El scrambler se presenta en el bloque verde de la figura 2. Como se Las formas de onda se guardan digitalmente como muestras de la
puede observar está formado por dos registros de desplazamiento señal analógica a recomponer con una precisión de 8 bits por mues-
(U14 y U18), un flip-flop (U17) y puertas XOR (U13). Es del tipo self- tra. Debido al almacenamiento digital de los datos se hace necesario
synchronising, y su funcionamiento será analizado en un artículo pos- utilizar un convertidor digital-analógico a la salida de la memoria para
terior. obtener la señal analógica a transmitir.
Los bits anteriores y posteriores se tienen en cuenta tomando las Los datos en el interior de esta memoria se agrupan en conjuntos
salidas de cada registro de desplazamiento como entradas al confor- de 4 muestras (subformas de onda), de tal manera que a cada com-
mador de pulsos. binación de las entradas de direccionamiento de esa memoria le
corresponde una subforma de onda diferente, como se puede obser-
CONFORMADOR DE PULSOS. var en la figura 3.
El conformador de pulsos se encarga de asociar el bit a enviar con En parte superior de la misma figura, se observa la señal resultante
una forma de onda que viajará por el canal, de manera que el recep- de la combinación "00001000". La señal se forma componiendo cua-
tor sea capaz de realizar el proceso inverso. tro puntos por cada bit a enviar. Se puede observar que los puntos de
la subforma de onda correspondientes a cada bit "0" son diferentes y
dependen de sus bits adyacentes (ISI).
Para conseguir direccionar las muestras dentro de cada subforma
se necesita un contador de 2 bits que sea capaz de realizar un ciclo
completo de cuenta (00,01,10,11) cada vez que se necesita enviar un
bit por la línea. Para ello conectamos dos señales de reloj a las entra-
das menos significativas de dirección de nuestra memoria, funcio-
nando una al doble del bit-rate (9600) y otra al cuádruple.
POSIBLES CONFIGURACIONES
En la figura 4 se puede observar el esquema de direccionamiento
empleado. Los dos bits menos significativos se toman de las señales
Figura 4
Figura 4
de reloj. La entrada CLK1 corresponde al reloj a 4*9600 y la entrada hacen un total de once bits. Para guardar las subformas de onda
CLK2 al reloj a 2*9600. Los siguientes ocho bits son los de salida del direccionables con 11 bits se necesitan 2Kbytes de memoria.
scrambler y subdireccionan lasdistintas subformas de onda. Con estos Teniendo en cuenta que la memoria disponible es de 16 Kbytes, con
diez bits sería suficiente para realizar el modulador, ya que contemplan esta configuración solamente podemos almacenar las formas de
las subformas de onda correspondientes a todas las combinaciones onda de 8 emisoras. Pero a cambio se consigue tener en cuenta el
de bits posibles. Para permitir un sistema más adaptable, se añaden efecto de un bit más sobre el pulso de cada símbolo enviado.
4 bits (los más significativos) que provienen de cuatro jumpers. Si conectamos todos los jumpers de manera que se tengan en
Estos cuatro jumpers permiten seleccionar el conjunto de subfor- cuenta todas las salidas disponibles del scrambler (12) podemos
mas de onda que se direcciona de manera que se pueden incluir dis- incluir en los pulsos de cada símbolo el efecto de los 11 bits adya-
tintas configuraciones. centes al bit actual, con lo que la recepción de los datos será mucho
En la parte inferior derecha de la figura 4 se puede observar la mejor que usando 8 bits. El inconveniente es que solo se podrá tra-
situación en el esquema electrónico de los jumpers (etiquetados bajar con una única emisora, ya que se emplean 14 bits (12 del scram-
como JMP 1-4). Si los jumpers no se utilizan, las entradas 21, 23, 2 bler más los 2 del reloj), que corresponden a los 16 Kbytes de la
y 26 de la EPROM se encuentran a uno, con lo que se direccionan las memoria.
partes más altas de la memoria. En cambio, si se disponen entre a y
b, las entradas se conectan a cero, direccionándose las partes más CONVERSIÓN DIGITAL ANALÓGICO
bajas de la memoria. Jugando con la disposición de los jumpers pode- Como se puede observar en el esquema electrónico de la figura 2,
mos direccionar una zona concreta de la memoria. la salida de la memoria es tomada como entrada a un DAC (conversor
Esto se utiliza para guardar formas de ondas adecuadas a distintos digital-analógico) de 8 bits. Este convertidor se encarga de generar la
receptores, de manera que se pueda seleccionar uno u otro receptor forma de onda analógica a partir de las muestras digitales seleccio-
sin más que alterar la situación de los jumpers. Esta característica nadas.
trata de paliar los inconvenientes derivados del uso de un ecualizador
en emisión. Así, conocido el tipo de receptor al que deseamos trans- FILTROS DE SALIDA
mitir, podemos seleccionar la configuración más adecuada para él. La señal analógica antes de ser enviada es filtrada por un filtro paso
Tal y como se ha mencionado anteriormente, para direccionar las bajo (Cauer de orden 3), con una frecuencia de corte (-3dB) de 10KHz
formas de onda de todas las combinaciones posibles se utilizan 10 aproximadamente. Este filtro permite eliminar los armónicos de alta
bits (8 del scrambler y 2 de los relojes), por lo que son necesarios frecuencia y evitar los efectos derivados de la conversión D/A (Alia-
1Kbytes de memoria. La memoria utilizada tiene 16 Kbytes, por lo sing), suavizando así la forma de la señal. La respuesta frecuencial de
que puede contener formas de onda para 16 receptores distintos. este filtro se puede observar en la figura 5.
Pero además tenemos otra posibilidad. Si colocamos los jumpers Cuanto más pronunciada sea la banda de transición, es decir, la
entre las posiciones b y c se conectan más bits del scrambler a la zona en la que la respuesta frecuencial del filtro comienza a caer, el
entrada de la memoria, con lo que se tienen en cuenta más bits a la filtro será mejor pero también más costoso de diseñar. Requerirá un
hora de generar la forma de onda del bit actual. Por supuesto será mayor numero de componentes con lo se encarece el circuito. Para
necesario dispones de una nueva memoria donde se emplean más nuestros propósitos el filtro empleado presenta una respuesta fre-
direcciones para cada forma de onda y por lo tanto habrá menos emi- cuencial aceptable.
soras disponibles. Con esta descripción damos por terminado el análisis del modula-
Si, por ejemplo, conectamos el primer jumper entre b y c se emple- dor. En el próximo artículo se desglosará el funcionamiento del demo-
arán nueve bits de salida del scrambler, que con los dos del reloj dulador.
URE (3/2000) - 19
Comunicaciones Digitales
EL MÓDEM G3RUH (IV)
Borja Etxebarria, Inma Hernáez, Ricardo Gándara, Itziar Martínez.
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DEMODULADOR definido dentro del demodula- FILTRO DE RECEPCIÓN BINARIZADOR O SLICER
En este artículo nos encontra- dor. En la figura 1 se presenta la Este filtro analógico de Tras el filtro de recepción nos
mos frente al demodulador. parte del esquema electrónico entrada se encarga de limitar la encontramos con un slicer o
Hasta ahora hemos convertido correspondiente al demodulador señal a la banda deseada, elimi- binarizador. Este se encarga de
una señal digital en una señal del módem, donde se pueden nando así el ruido fuera de convertir la señal analógica de
analógica con las características distinguir varios bloques. En banda. Se trata de un filtro de entrada en una señal digital, es
necesarias para ser transmitida naranja se presenta el filtro de Cauer de orden 3, cuya frecuen- decir, actúa como un convertidor
mediante el modulador. Poste- recepción, en morado el uns- cia de corte a 3dB tiene lugar a analógico digital (cuantificador)
riormente esta señal ha atrave- crambler y en amarillo el bloque 6023 Hz y comienza a atenuar de dos niveles. Para ello com-
sado nuestro transmisor y ha lle- encargado de la recuperación de en torno a los 4800 Hz. La para la señal de entrada con un
gado al receptor destino. Este sincronismo (que extrae el reloj) característica frecuencial del fil- nivel de referencia de 6 V, de
devuelve una señal analógica de y la detección de portadora tro se puede observar en la forma que si la señal de entrada
la que pretendemos recuperar la (señal de DCD). figura 2. es mayor, el binarizador produce
señal digital original.
Pero, ¿cómo realizamos este
proceso?
La obtención de la señal bina-
ria original a partir de la señal
analógica recibida se denomina
demodulación y es el tema de
este artículo. El demodulador no
sólo debe recuperar la señal
digital y entregársela a la TNC (o
software de PC equivalente).
Además, la TNC precisa de una
señal de reloj con la que recupe-
rar los datos y una señal DCD
(Data Carrier Detect) que le per-
mita reconocer la llegada de
datos. Todas estas señales las
obtendrá el demodulador a partir
de la señal analógica recibida.
Cada una de estas señales
se genera en un bloque bien Figura 1
un uno lógico (5 V) y en caso
contrario un cero lógico (0 V).
Este proceso es necesario
porque los bloques que se inclu-
yen a continuación sólo pueden
tratar son señales digitales. Las
señales analógicas pueden pro-
ducir niveles de tensión no váli-
dos para circuitos CMOS, de
manera que la salida del circuito
digital no sería previsible (esto
va en contra de cualquier buen
diseño). De este modo la señal a
procesar por el resto de las eta-
pas es la señal digital binari-
zada, sin volver a recurrir a la
señal analógica original.
La consideración de cuantifi-
car a dos niveles es suficiente
porque la señal de entrada está
generada mediante un sistema
PAM de dos niveles que se recu-
Figura 2 peran como 0 y 12 V, es decir,
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transporta la información en dos El funcionamiento de todos momento preciso en el cual que- a un sistema que permite gene-
niveles de amplitud. los bloques explicados hasta el remos indicarle a la TNC que rar una señal de frecuencia y
momento se puede observar en debe tomar el bit. fase controlable mediante una
DETECCIÓN DE SINCRONISMO la figura 3. Los nombres de las Pero esta señal no es válida señal externa. En nuestro caso,
El sistema de detección de señales corresponden a los pun- como señal de reloj por dos razo- la señal externa es el protorre-
sincronismo se encarga de recu- tos indicados en el esquema nes. En primer lugar, el protorre- loj. En base a él, el PLL genera
perar una señal de reloj válida a electrónico de la figura 1. La grá- loj puede presentar ciclos perdi- una señal de reloj sin ciclos per-
partir de la señal binarizada con- fica superior muestra la señal dos. Esto ocurre cuando la señal didos y con un jitter limitado,
seguida en el filtro de recepción. de salida del filtro de recepción de entrada no presenta ningún resultando una señal de reloj
Por una señal de reloj válida (señal A). La señal A entra al sli- cambio de nivel (dos o más unos válida.
entendemos una señal binaria cer y proporciona como salida la
periódica estable a la frecuencia señal B, tomando como nivel de
de recepción de los datos (nomi- referencia el indicado por la
nalmente 9600 Hz), y cuyo flanco línea horizontal presente en la
de subida esté sincronizado con señal A.
el instante de detección óptimo La señal B entra en el registro
de la señal binaria de entrada de desplazamiento, cuya salida
(mitad del periodo de bit). es la señal C. Se puede observar
Para lograr este propósito, el como la señal C es una réplica
sistema se divide en dos subsis- de la señal B retardada medio
temas: el detector de pasos por periodo.
cero y el PLL (Phase Locked Las señales B y C entran a
Loop, lazo enganchado en fase). una puerta XOR. La salida de
El primero se encarga de generar esta es la señal D, que presenta
Figura 4
URE (4/2000) - 23
Comunicaciones Digitales
16 muestras de la EPROM con- siempre habilitado y emplea tratará de llegar hasta este mismo instante que el flanco de
formándose un periodo completo como señal de reloj el protorre- estado estable. bajada del reloj. En esta situa-
de señal sinusoidal, para lo que loj. Para movernos arriba o abajo Estos tres estados y la evolu- ción, la forma de onda direccio-
se emplea un reloj cuya frecuen- en las formas de onda se intro- ción del sistema en cada uno de nada debería seguir siendo la
cia es igual a 16 veces la fre- duce a la entrada UP/DOWN la ellos se pueden observar en la misma, tal y como se ve en la
cuencia nominal del módem. señal de reloj. figura 6. señal E. En realidad, debido a la
Como este contador siempre El funcionamiento del PLL se La primera columna de la forma en que está implemen-
está habilitado, están saliendo basa en comparar el estado de figura 6 muestra la situación en tado el módem, el contador debe
muestras de la EPROM en todo la señal de reloj generada con el la que la señal de reloj está ade- forzosamente avanzar o retroce-
momento. De este modo arregla- del protorreloj invertido (negado). lantada respecto al protorreloj. der de forma de onda en función
mos el problema de los ciclos El resultado de la comparación En este caso el flanco de subida del valor que tome UP/DOWN en
del protorreloj invertido llega ese instante (no podemos saber
cuando la señal de reloj ya exactamente si UP/DOWN
está a nivel lógico cero. De tomará valor lógico uno o cero).
este modo el contador de 8 El estado estable real será la
bits tiene activa la señal alternancia de uno/cero/uno/
DOWN, por lo que direcciona a cero/uno... en la secuencia de
la anterior forma de onda de valores del reloj en el flanco de
la memoria, que está retra- subida del protorreloj, de
sada respecto a la actual. En manera que el sistema oscila
la figura 6, la nueva forma de alrededor del estado estable
onda seleccionada se pre- teórico.
senta en verde. Con este bucle cerrado reali-
En la segunda columna se mentado, evitamos el segundo
observa la situación en la que problema que impedía la validez
la señal de reloj está retra- del protorreloj: el jitter. La des-
sada respecto al protorreloj. viación de fase entre periodo y
Figura 5
Cuando llega el flanco de subida periodo de reloj, únicamente
del protorreloj invertido, la señal puede ser, tal y como está dise-
perdidos, ya que tendremos se emplea para corregir el reloj de reloj todavía se encuentra a ñado el sistema, de 1/256
siempre a la salida una señal generado. nivel uno lógico. Por tanto, el veces el periodo de bit.
sinusoidal estable. Para analizar el comporta- contador tiene activa la señal UP
Esta señal sinusoidal es bina- miento del PLL vamos a conside- y se direcciona la siguiente DETECCIÓN DE PORTADORA
rizada para obtener el reloj rar las tres posibles situaciones forma de onda de la memoria, El subsistema de detección
válido. en las que nos encontraremos. que está adelantada respecto a de portadora es el encargado de
Cada forma de onda sinusoi- En primer lugar, es posible que la actual. decidir si se están recibiendo
dal incluye un periodo completo el reloj se encuentre adelantado La nueva forma de onda selec- datos, o por el contrario, lo único
y está desfasada con respecto a respecto al protorreloj invertido. cionada se encuentra en verde. que se recibe es ruido proce-
la siguiente 360/256 grados. El caso contrario es que se En la tercera columna se dente del canal. Se basa en
De este modo conseguimos que encuentre retrasado y el caso muestra el estado estable, en la hacer una XOR del protorreloj y
la ultima forma de onda de la ideal es que ambas señales se que el flanco de subida del pro- del reloj invertido y filtrar paso-
memoria esté también desfa- encuentren en fase. El sistema torreloj invertido sucede en el bajo el resultado.
sada 360/256 grados con res- El módem presenta dos
pecto a la primera forma de onda posibles configuraciones
de la EPROM. Tenemos enton- para activar la señal de
ces un buffer circular de 256 for- DCD.
mas de onda, en el cual despla- Esta señal puede ser
zándonos hacia arriba o hacia activa a nivel alto o a nivel
abajo (ver figura 4), nos retrasa- bajo. La configuración se
mos o adelantamos en fase res- realiza mediante un conmu-
pectivamente. Para su direccio- tador a la salida de este
namiento se emplea el contador subsistema (en el punto I
de 8 bits, formado por dos con- del esquema electrónico de
tadores de cuatro bits conecta- la figura 1). Para analizar el
dos convenientemente. Este funcionamiento de este blo-
contador está conectado a las que, supondremos que la
ocho entradas más significativas señal DCD es activa a nivel
de la EPROM, de manera que alto.
direcciona la forma de onda de En la figura 7 se observa
las 256 existentes en la memo- la situación en la que se
ria que sale en cada momento. están recibiendo datos y se
Este contador también está ha llegado al estado esta-
Figura 6
24 - URE (4/2000)
Figura 7 Figura 8
ble de la recuperación de sincro- dos con el periodo de bit) la será una señal aleatoria debida UNSCRAMBLER
nismo. En este estado, el proto- salida de la XOR sea un nivel al ruido del canal (señal D), la En el modulador, se pasan
rreloj (señal D) y el reloj generado lógico cero (0 V). Aun con cual dará a través de la XOR, los bits por el scrambler para
(señal F) estarán en fase. estos cambios, el valor medio otra señal aleatoria (señal G), su aleatorización antes de ser
Entonces, el reloj invertido y el de la señal de salida se sitúa independientemente del valor modulados. Ahora, tras binari-
protorreloj estarán en contrafase. en torno a 3,3 V. Esta señal del reloj generado (señal F). En zar la señal de entrada, se
Si hacemos la XOR de estos dos pasa por un filtro paso-bajo RC la señal G, los unos y los ceros debe desaleatorizar la secuen-
valores (señal G) obtendremos sencillo (señal H) y después lógicos aparecen aproximada- cia recibida para recuperar la
un nivel lógico uno (5 V). por un slicer (señal I) con un mente en la misma proporción, secuencia original. Para ello se
Este valor no será uno cons- nivel de referencia de 3 V, por por lo que al filtrar paso-bajo, utiliza el bloque llamado uns-
tantemente, ya que tanto peque- lo que el valor obtenido será obtendremos un valor medio crambler.
ñas desviaciones de fase entre un nivel lógico uno (DCD estable entre 0 (0 V) y 1 (5 V), es Precisamente a este bloque
protorreloj y reloj, como las activo). decir, aproximadamente 2,5 V dedicamos el próximo artículo
imperfecciones del protorreloj La figura 8 muestra la situa- (señal H). Al pasar la señal por el de esta serie.
harán que durante pequeños ción en la que no se están filtro paso-bajo y por el slicer, el
periodos de tiempo (compara- recibiendo datos. El protorreloj nivel lógico obtenido será cero.
URE (4/2002) - 17
Comunicaciones Digitales
Figura 4
18 - URE (4/2002)
tres a la salida del scrambler, decir, utiliza un registro de des-
uno debido a la XOR de entrada y plazamiento de 17 etapas, reali-
los otros dos cada vez que dicho zándose la realimentación con
bit es realimentado. Pero este las etapas 12 y 17. Este registro
problema no resulta ser impor- de desplazamiento está construi-
tante para la transmisión bajo do a partir de tres circuitos inte-
AX.25, ya que las transmisiones grados: dos 74164, que son
se estructuran en paquetes y el registros de desplazamientos de
error en un bit hace que no se 8 bits, y un flip-flop tipo D.
obtenga un CRC válido y se tenga Tal y como se mencionó en el
que retransmitir el paquete. Por artículo anterior, el módem
eso carece de importancia que G3RUH presenta la particularidad
un error se multiplique por tres. de tomar como salida del scram-
En cambio, si estuviéramos bler tanto lo que hasta ahora
empleando un código corrector hemos tomado como salida
Figura 5 de errores, si resultaría importan- como los valores de las etapas
te, ya que la capacidad de correc- intermedias.
SINCRONIZACIÓN todos los registros con entradas ción de estos códigos es limita- En cuanto al descrambler, éste
Puesto que tanto el scrambler conocidas, funcionando a partir da. no presenta ninguna desviación
como el descrambler se basan de entonces adecuadamente. respecto al esquema general.
en una realimentación a partir de SCRAMBLER Y DESCRAMBLER EN Con este artículo finaliza la
registros, ambos se sincronizan EXTENSIÓN DEL ERROR EL MÓDEM G3RUH entrega dedicada al módem
automáticamente. El único incon- Uno de los inconvenientes de El scrambler/descrambler G3RUH. Queremos agradecer a la
veniente es que para un scram- los scramblers autosincroniza- empleado en este módem es URE, así como a Jabier Aguirre
bler de N etapas habrá que intro- bles es que por cada error en la autosincronizable. El polinomio (EA2ARU), la oportunidad de cola-
ducir N símbolos para llenar detección de un bit se producen que emplea es 1 + x12 + x17, es boración que nos han ofrecido.