UNIVERSIDAD NACIONAL DE SAN AGUSTÍN DE AREQUIPA
VICERRECTORADO ACADÉMICO
FACULTAD DE INGENIERIA DE PRODUCCION Y SERVICIOS
DEPARTAMENTO ACADÉMICO DE ING. ELECTRONICA
SÍLABO 2020 - B
ASIGNATURA: ARQUITECTURA DE COMPUTADORAS
1. INFORMACIÓN ACADÉMICA
Periodo académico: 2020 - B
Escuela Profesional: INGENIERÍA ELECTRÓNICA
Código de la asignatura: 1704256
Nombre de la asignatura: ARQUITECTURA DE COMPUTADORAS
Semestre: VIII (octavo)
Duración: 17 semanas
Teóricas: 0.0
Prácticas: 6.0
Número de horas (Semestral) Seminarios: 0.0
Laboratorio: 2.0
Teórico-prácticas: 0.0
Número de créditos: 4
Prerrequisitos: MICROELECTRONICA (1704146)
2. INFORMACIÓN DEL DOCENTE, INSTRUCTOR, COORDINADOR
DOCENTE GRADO ACADÉMICO DPTO. ACADÉMICO HORAS HORARIO
Lun: 08:50-10:30
SULLA ESPINOZA, ERASMO ING. ELECTRONICA 4 Mié: 08:50-10:30
Vie: 08:50-10:30
Lun: 08:50-10:30
TALAVERA SUAREZ, JESUS ING. ELECTRONICA 0 Mié: 08:50-10:30
Vie: 08:50-10:30
Lun: 15:50-17:30
SULLA ESPINOZA, ERASMO ING. ELECTRONICA 4 Mié: 15:50-17:30
Vie: 15:50-17:30
Lun: 15:50-17:30
TALAVERA SUAREZ, JESUS ING. ELECTRONICA 0 Mié: 15:50-17:30
Vie: 15:50-17:30
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3. INFORMACIÓN ESPECIFICA DEL CURSO (FUNDAMENTACIÓN, JUSTIFICACIÓN)
El curso permite al estudiante el logro de un elevado rendimiento en el uso de dispositivos hardware más
rápidos y fiable, sino que se apoya también en la obtención de mejoras importantes en la arquitectura de
computadoras y en las técnicas de procesamientos, ya sea como parte de sistemas embebidos o en
computadores de propósito general, se han vuelto fundamentales en prácticamente cualquier nuevo
producto. Esto ha dado un gran impulso al diseño de las arquitecturas de los procesadores, que
actualmente alcanzan niveles muy altos de complejidad. Durante las últimas décadas la introducción de los
computadores ha experimentado un desarrollo marcadas físicamente por la rápida evolución de los
bloques de construcción, desde los relés hasta los circuitos integrados de alta y muy alta escala
(LSI/VLSI). Los incrementos en velocidad y fiabilidad de los dispositivos, la reducción en los costos y
tamaño físico del hardware han potenciado el rendimiento de los computadores. Tener conocimiento de la
aplicación de los computadores en la Robótica
4. COMPETENCIAS/OBJETIVOS DE LA ASIGNATURA
a).- Distinguir entre los distintos tipos de arquitecturas de procesador más utilizados actualmente y evaluar
sus prestaciones.
b).-Analizar la interacción entre tecnología, arquitectura y aplicaciones, ilustrando la influencia de la
tecnología, la forma en que los elementos de una arquitectura afectan a sus prestaciones y limitan su
aplicabilidad.
c).-Optimizar código teniendo en cuenta las características de la arquitectura.
d).-Estudiar las fuerzas que condicionan la evolución de la arquitectura para adquirir visiones plausibles del
futuro.
e) Describir la estructura y organización de arquitecturas multihebra, multinúcleo y multiprocesador,
explicar lo que hace un compilador para aprovechar una arquitectura multinúcleo y multiprocesador.
f) Explicar la necesidad de mantener coherencia entre caches y entre cache y memoria principal, afrontar
el análisis y diseño de protocolos de mantenimiento de coherencia en multicores y multiprocesadores.
g) Distinguir entre los diferentes tipos de modelos de consistencia de memoria y explicar la influencia en
las prestaciones de un computador del modelo de consistencia de memoria.
5. CONTENIDO TEMATICO
PRIMERA UNIDAD
Capítulo I: : Introducción :Paralelismo e Incremento de Prestaciones
Tema 01: Tema 01: 1.1.- El concepto de arquitectura 1.2.- Evolución y prestaciones de las
arquitecturas.
Tema 02: Tema 02: 1.3.- El paralelismo en las arquitecturas 1.4.- Evaluación de prestaciones
de un computador
Capítulo II: Segmentación de Cauce y Procesadores Segmentados
Tema 03: 2.1.- Introducción: definición y notas históricas 2.2.- Principios de la segmentación y
mejora de prestaciones.
Tema 04: 2.3.- Diseño de un procesador segmentado, gestión de riesgos de datos, control y
estructuras 2.4.- El espacio de diseño de los procesadores segmentados
Tema 05: Tema 05: 2.5.-Optimización de cauces funcionales 2.6.- Interrupciones en un
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procesador segmentado. 2.7.- La familia de procesadores ARM
SEGUNDA UNIDAD
Capítulo III: Procesadores Superescalares: Microarquitecturas y Principios de Funcionamiento
Tema 06: Tema 06: 3.1.- Introducción: definición y notas históricas 3.2.- Paralelismo entre
instrucciones (ILP) y paralelismo de la maquina
Tema 07: Tema 07: 3.3.- Procesamiento superescalar de instrucciones. [Link] de
las instrucciones de salto 3.5.- Interrupciones en un procesador superescalar
Capítulo IV: Interconexión de Procesador - Memoria.
Tema 08: Tema 08: 4.1.- Acceso al Sistema de Memoria 4.2.- Los Circuitos de Memoria
Tema 09: Tema 09: Tema 09: 4.3.- Interconexiones 4.4.- Problemas
TERCERA UNIDAD
Capítulo V: Procesadores VLIW
Tema 10: Tema 10: 5.1.- Introducción motivación, definiciones y notas históricas. 5.2.-
Aprovechamiento del paralelismo en las arquitecturas VLIW
Tema 11: Tema 11: 5.3.-Recursos de apoyo al compilador 5.4.- Ejemplos de procesadores
VLIW y perspectivas futuras
Capítulo VI: Procesadores Vectoriales
Tema 12: Tema 12: 6.1.- Introducción: motivación, definiciones y notas históricas. 6.2.-
Arquitectura vectorial y prestaciones.
Tema 13: Tema 13: 6.3.- El sistema de memoria en los procesadores vectoriales. 6.4.-
Medidas de rendimiento en los procesadores vectoriales
Tema 14: Tema 14: 6.5.- Eficiencia del procesamiento vectorial 6.6.- Ejemplo de procesador
vectorial: Earth Simulator
Capítulo VII: : Introducción: Computadoras Paralelas, Programación Paralela y Prestaciones
Tema 15: Tema 15: 7.1.- Arquitectura Paralelas y Niveles de Paralelismo. 7.2.- Motivación al
estudio de Computadores Paralelos.
Tema 16: Tema 16: 7.3.- Espacio de diseño. Clasificación y Estructura General. 7.4.-
Programación Paralelo
Tema 17: Tema 17: 7.5.- Prestaciones en Computadores Paralelos 7.6.- Problemas
6. PROGRAMACIÓN DE ACTIVIDADES DE INVESTIG. FORMATIVA Y RESPONSABILIDAD SOCIAL
6.1. Métodos
a).- Tipo virtual, seminario con exposición y participación de los alumnos en el desarrollo de clases.
b).- Diseñar y configurar un sistema para que se ajuste a los requisitos establecidos.
c).-Aprovechar las características de funcionamiento del computador para escribir programas, sistemas
operativos y compiladores eficaces, que permitan a las distintas aplicaciones obtener el nivel de
prestaciones que precisan
6.2. Medios
Internet: meet
Prestaciones power point, vídeos
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Fórum
Aula virtual clases virtuales sincronas y asíncronas
Simuladores y programas para ensamblador bajo nivel: Debug, EMU8086 y Assembler en sus versiones
de prueba o demostrativas
6.3. Formas de organización
Realizar seminarios con participación de los alumnos.
Laboratorio.
Tutorías.
6.4. Programación de actividades de investigación formativa y responsabilidad social
Las actividades programadas para integrar la investigación formativa y responsabilidad social son clases
Virtruales, teoricas, seminarios y forum en los cuales los alumnos aprenderán la importancia de la
operación y mantenimiento de los computadores en las empresas y en laboratorio realizamos mediciones y
contrastando con equipo existente.
Apoyar en las actividades que realiza la Universidad/Región, con participación de los estudiantes del
curso.
7. CRONOGRAMA ACADÉMICO
SEMANA TEMA DOCENTE % ACUM.
Tema 01: 1.1.- El concepto de arquitectura 1.2.- Evolución y
1 J. Talavera S. 5 5.00
prestaciones de las arquitecturas.
Tema 02: 1.3.- El paralelismo en las arquitecturas 1.4.- Evaluación de
2 J. Talavera S. 6 11.00
prestaciones de un computador
2.1.- Introducción: definición y notas históricas 2.2.- Principios de la
3 J. Talavera S. 5 16.00
segmentación y mejora de prestaciones.
2.3.- Diseño de un procesador segmentado, gestión de riesgos de
4 datos, control y estructuras 2.4.- El espacio de diseño de los J. Talavera S. 6 22.00
procesadores segmentados
Tema 05: 2.5.-Optimización de cauces funcionales 2.6.-
5 Interrupciones en un procesador segmentado. 2.7.- La familia de J. Talavera S. 6 28.00
procesadores ARM
Tema 06: 3.1.- Introducción: definición y notas históricas 3.2.-
6 J. Talavera S. 6 34.00
Paralelismo entre instrucciones (ILP) y paralelismo de la maquina
Tema 07: 3.3.- Procesamiento superescalar de instrucciones.
7 [Link] de las instrucciones de salto 3.5.- Interrupciones J. Talavera S. 6 40.00
en un procesador superescalar
Tema 08: 4.1.- Acceso al Sistema de Memoria 4.2.- Los Circuitos de
8 J. Talavera S. 6 46.00
Memoria
9 Tema 09: Tema 09: 4.3.- Interconexiones 4.4.- Problemas J. Talavera S. 6 52.00
Tema 10: 5.1.- Introducción motivación, definiciones y notas
10 históricas. 5.2.- Aprovechamiento del paralelismo en las arquitecturas J. Talavera S. 6 58.00
VLIW
Tema 11: 5.3.-Recursos de apoyo al compilador 5.4.- Ejemplos de
11 J. Talavera S. 6 64.00
procesadores VLIW y perspectivas futuras
Página 4 / 6
Tema 12: 6.1.- Introducción: motivación, definiciones y notas
12 J. Talavera S. 6 70.00
históricas. 6.2.- Arquitectura vectorial y prestaciones.
Tema 13: 6.3.- El sistema de memoria en los procesadores
13 vectoriales. 6.4.- Medidas de rendimiento en los procesadores J. Talavera S. 6 76.00
vectoriales
Tema 14: 6.5.- Eficiencia del procesamiento vectorial 6.6.- Ejemplo de
14 J. Talavera S. 6 82.00
procesador vectorial: Earth Simulator
Tema 15: 7.1.- Arquitectura Paralelas y Niveles de Paralelismo. 7.2.-
15 J. Talavera S. 6 88.00
Motivación al estudio de Computadores Paralelos.
Tema 16: 7.3.- Espacio de diseño. Clasificación y Estructura General.
16 J. Talavera S. 6 94.00
7.4.- Programación Paralelo
Tema 17: 7.5.- Prestaciones en Computadores Paralelos 7.6.-
17 J. Talavera S. 6 100.00
Problemas
8. ESTRATEGIAS DE EVALUACIÓN
8.1. Evaluación del aprendizaje
1.- Evaluación Continua
1.1 Pruebas temas actualizados: tecnología, paper.
1.2 Trabajos de laboratorio:
2.- Evaluación Periódica.
2.1 Primer Examen.
2.2 Segundo Examen.
2.3 Tercer Examen
8.2. Cronograma de evaluación
EVALUACIÓN FECHA DE EVALUACIÓN EXAMEN TEORÍA EVAL. CONTINUA TOTAL (%)
Primera Evaluación Parcial 09-10-2020 16% 17% 33%
Segunda Evaluación Parcial 20-11-2020 16% 17% 33%
Tercera Evaluación Parcial 23-12-2020 17% 17% 34%
TOTAL 100%
9. REQUISITOS DE APROBACIÓN DE LA ASIGNATURA
a) El alumno tendrá derecho a observar o en su defecto ratificar las notas consignadas en sus
evaluaciones, después de ser entregadas las mismas por el profesor, salvo el vencimiento del plazo para
culminación del semestre académico, luego del mismo, no se admitirá reclamaciones, el alumno que no se
haga presente el día establecido, perderá su derecho a reclamo.
b) Para aprobar el curso el alumno debe obtener una nota igual o superior a 10,5 en el promedio final.
c) El redondeo solo se efectuará en el cálculo del promedio final, quedando expreso que las notas
parciales no se redondearán individualmente.
d) El alumno que no tenga alguna de sus evaluaciones y no haya solicitado evaluación de rezagados en el
plazo oportuno, se le considerará como abandono.
e) El alumno quedará en situación de ?abandono? si el porcentaje de asistencia al laboratorio es menor al
noventa por ciento (90%) y tener como nota aprobatoria mínima de 10,50.
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10. BIBLIOGRAFIA: AUTOR, TÍTULO, AÑO, EDITORIAL
10.1. Bibliografía básica obligatoria
[1] A). - ARQUITECTURA DE OMPUTADORES
Julio Ortega, Mancia Anguita, Alberto Prieto, 2005
B). - FUNDAMENTOS Y PROBLEMAS DE ARQUITECTURA DE COMPUTADORAS
Mancia Anguita, Julio Ortega Lopera, 2016
10.2. Bibliografía de consulta
[2] PARALLEL PROGRAMMING FOR MULTICORE AND CLUSTER SYSTEMS, Thomas Rauber · Gudula
Runger
[3] ADVANCED COMPUTER ARCHITECTURE, Kai Hwang
[4] ARQUITECTURA DE COMPUTADORAS Y PROCESAMIENTO PARALELO, Kai Hwang, Faye A.
Brigg
[5] ORGANIZACIÓN DE COMPUTADORAS UN ENFOQUE ESTRUCTURAL Andrews Tanenbaum
[6] ARQUITECTURA DE COMPUTADORAS M. Morris Mano
[7] UPGRADING AND REPAIRING PCS Scott Mueller ED 21
[8] ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Jaime Martinez G. Jorge Olvera R.
[9] ENLACES RECOMENDADOS
? Procesadores de Intel: [Link]
? Procesadores de AMD: [Link]
? Procesadores Power: [Link]
? Eclipse: [Link]
? TORQUE: [Link]
? OpenMP: [Link]
? Gcc/g++: [Link]
?Android [Link]
Arequipa, 18 de Setiembre del 2020
SULLA ESPINOZA, ERASMO TALAVERA SUAREZ, JESUS
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