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Práctica VHDL en Circuitos Secuenciales

El documento describe dos problemas de circuitos secuenciales para ser implementados en VHDL. El primer problema involucra una máquina de estados finitos con una tabla de estados y el segundo un contador BCD ascendente/descendente con reset. El documento también describe el flujo de diseño para implementar los circuitos en un FPGA.

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Jhoel René Mamani Huanca
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El documento describe dos problemas de circuitos secuenciales para ser implementados en VHDL. El primer problema involucra una máquina de estados finitos con una tabla de estados y el segundo un contador BCD ascendente/descendente con reset. El documento también describe el flujo de diseño para implementar los circuitos en un FPGA.

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Universidad Nacional de San Agustín

Escuela Profesional de Ingeniería Electrónica

Microelectrónica

Práctica 2

Circuitos Secuenciales

[ Grupo 03 ]

Alumnos:
Mamani Huanca, Jhoel René
Mendoza Cari, Ivan Marcos
Vilcapaza Goyzueta, Denilson
Yanapa Ccoarite, Rony Miguel

Docente:
PhD. Alexander B. Hilario Tacuri

Arequipa, Mayo del 2020


Contenido
Microelectrónica Circuitos Secuenciales

Práctica 02
1. Objetivos

ˆ Usar la descripción estructural en VHDL.

ˆ Probar circuitos secuenciales en un FPGA.

2. Programación en VHDL

ˆ Revise el material referente al curso.

3. Desarrollo de la práctica

ˆ Problema 01: Un circuito secuencial tiene una entrada X, una señal de reloj CLK y dos salidas S y V.
Escriba un código en VHDL que implemente la tabla de estados presentada en la Tabla 1 e indique el
objetivo de esta maquina de estados.

Estado actual Siguiente estado Salida


S0 x=0 x=1 x=0 x=1
S1 S1 S2 1,0 0,0
S2 S3 S4 1,0 0,0
S3 S4 S4 0,0 1,0
S4 S5 S5 0,0 1,0
S5 S5 S6 1,0 0,0
S6 S0 S0 0,0 1,0
S7 S0 S0 1,0 0,1
Tabla 1: Tabla de estados problema 1

ˆ Problema 02: Escriba un código en VHDL para Implementar un contador BCD. Este contador debe
tener la opción de escoger si es ascendente o descendente y ademas debe contar con un pulsador de reset.

4. Flujo de Diseño

Cree un nuevo proyecto Vivado. Seleccione el dispositivo FPGA Artix-7

ˆ Escriba el código VHDL para los dos problemas usando la descripción estructural: Crear un archivo
separado para cada una de las operaciones y un archivo principal.
ˆ Escriba el test-bench VHDL para probar los casos más signicativos.

ˆ Realice la Functional Simulation y la Timing Simulation.

ˆ Asignación de entradas y salidas: Utilice los switches y pulsadores de la placa como entradas y los leds
y display de 7 segmentos como salidas.
ˆ Generar el archivo bitstream (Generate Bitstream).

ˆ Descargar el bitstream en el FPGA.

Universidad Nacional de San Agustín - Arequipa 1


Microelectrónica Circuitos Secuenciales

2x − 5y = 8
3x + 9y = −12

x=y w=z a=b+c


1
2x = −y 3w = z a=b
2
−4 + 5x = 2 + y w + 2 = −1 + w ab = cb

2x − 5y = 8
2
3x + 9y = 3a + c

p(x) = 3x6 + 14x5 y + 590x4 y 2 + 19x3 y 3


− 12x2 y 4 − 12xy 5 + 2y 6 − a3 b3

Universidad Nacional de San Agustín - Arequipa 2

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