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Circuitos Combinacionales en VHDL

Este documento presenta un trabajo sobre circuitos combinacionales descritos en el lenguaje VHDL. El trabajo incluye la descripción de múltiples multiplexores, decodificadores y codificadores de diferentes tamaños utilizando sentencias with-select en VHDL, así como pantallazos de la simulación que muestran su correcto funcionamiento. El objetivo es familiarizar al estudiante con conceptos lógicos de circuitos digitales y acelerar el proceso de diseño a través del uso de herramientas de simulación y descripción como VH

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Circuitos Combinacionales en VHDL

Este documento presenta un trabajo sobre circuitos combinacionales descritos en el lenguaje VHDL. El trabajo incluye la descripción de múltiples multiplexores, decodificadores y codificadores de diferentes tamaños utilizando sentencias with-select en VHDL, así como pantallazos de la simulación que muestran su correcto funcionamiento. El objetivo es familiarizar al estudiante con conceptos lógicos de circuitos digitales y acelerar el proceso de diseño a través del uso de herramientas de simulación y descripción como VH

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CIRCUITOS COMBINACIONALES

TAREA 2

Presentado por
JOSE ISAACS LOZANO CRUZ
CODIGO GRUPO

CURSO
ELECTRONICA DIGITAL
243004

PRESENTADO A

UNIVERSIDA ABIERTA Y A DISTANCIA-UNAD


ESCUELA DE CIENCIAS BASICAS, TECNOLOGIA E INGENIERIA
FEBRERO 2020
INTRODUCCION

En este trabajo se hallan conceptos lógicos de análisis de circuitos de electrónica digital


desde la descripción de circuitos combinacionales en el lenguaje VHDL programa que
permite acelerar el proceso de diseño digital.
El trabajo presentado es una tarea de curso de electrónica digital y es para familiarizar al
estudiante con los temas plateados por esta materia, como lo son el software VHDL
analizando por medio de estos problemas complejos que llevarían más tiempo e
infinidad de circuitos, minimizando el tiempo y el circuito obtenido.
Actividades a desarrollar

Resolver los siguientes ejercicios:

1. Describa en VDHL tres multiplexores utilizando la sentencia with-select. Los tres


multiplexores deben tener un tamaño diferente (2 a 1, 8 a 1, etc.) y cada entrada un
número de bits diferente.
a. Una impresión de pantalla de la descripción en VHDL (Ver la advertencia
al final de la guía, con respecto a las impresiones de pantallas válidos)
b. Una impresión de pantalla del resultado (diagrama) de la simulación, en el cual
se debe evidenciar el correcto funcionamiento del diseño. NO se debe incluir el
código VHDL de la simulación.

Multiplexor 4 entradas 8 bits descripción con sentencia with select


Pantalla de simulación en hexadecimal
Multiplexor de 2 entradas a 4 bits

Simulación del multiplexor de 2 entradas a 3 bits.


Multiplexor de 16 bits 16 entradas

Simulación de multiplexor de 16 bits, 16 entradas.


2. Describa en VDHL un decodificador de 3 entradas utilizando la sentencia with-
select.
El diseño debe contener:
a. Una impresión de pantalla de la descripción en VHDL.
b. Una impresión de pantalla de la simulación, en el cual se debe evidenciar el
correcto funcionamiento del diseño.

Decodificador de 3 entradas con sentencia with select.


Simulación del decodificador

3. Describa en VDHL un codificador de 4 entradas, sin prioridad, utilizando la


sentencia with-select.
El diseño debe contener:
a. Una impresión de pantalla de la descripción en VHDL.
b. Una impresión de pantalla de la simulación, en el cual se debe evidenciar el
correcto funcionamiento del diseño.
Decodificador 4 entradas, sin prioridad con sentencia with select.

Simulación decodificador 4 entradas, sin prioridad con sentencia with select.

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