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H bitとは 意味・読み方・使い方
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「H bit」の部分一致の例文検索結果
該当件数 : 139件
A second memory cell stores h-bit (h<k) data in one cell.例文帳に追加
第2メモリセルは、1セルにhビット(h<k)のデータを記憶する。 - 特許庁
When the ENA1 reaches the 'H' level, a 2-bit counter is reset to have an output of '00'.例文帳に追加
ENA1が“H”レベルになると、2ビットカウンタはリセットされ、出力“00”となる。 - 特許庁
An ABS value detecting part 24 sets a bit to be H when the bit is determined as H, or sets a bit L when the bit is determined as L according to the both threshold values.例文帳に追加
ABS値決定部24は、先ず、両方のしきい値によって「H」と判断されたビットを「H」と決定し、「L」と判断されたビットを「L」を決定する。 - 特許庁
Undetermined bits is determined as H when a neighboring bit is L, or L when a neighboring bit is H.例文帳に追加
決定していないビットは、隣接したビットが「H」であるときには「L」、「L」であるときには「H」と決定する。 - 特許庁
I-bit (i<=k) data are stores in the first memory cell, and h-bit (h<i) data generated from the i-bit data are stored in the second memory cell.例文帳に追加
第1メモリセルにiビット(i<=k)のデータを記憶し、第2メモリセルにiビットのデータより生成されるhビット(h<i)のデータを記憶する。 - 特許庁
Furthermore, an adder 23 sums the value H-(l,kp,l) and the output of the bit shift circuit 22, a bit shift circuit 25 shifts the obtained sum by one bit to obtain a value H-(l+1,kp,l+1).例文帳に追加
また、H~(l,k_p,l)とビットシフト回路22の出力を加算器23で加算し、ビットシフト回路25でビットシフトしてH~(l+1,k_p,l+1)を得る。 - 特許庁
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「H bit」の部分一致の例文検索結果
該当件数 : 139件
When interrupt factor signals INTa-h are generated, flag bit registers 1a-1h hold 'H'.例文帳に追加
割込み要因信号INTa〜hが発生すると、フラグビットレジスタ1a〜1hは、“H”を保持する。 - 特許庁
The count value H by an upper bit counter part and the count value L by a lower bit counter part are connected to be made into N bit digital data.例文帳に追加
上位ビットカウンタ部でのカウント値Hと下位ビットカウンタ部でのカウント値Lとを繋ぎNビットデジタルデータにする。 - 特許庁
Similarly, an adder 24 sums the value H-(l+4,kp,l+4) and the output of the bit shift circuit 22, and a bit shift circuit 26 shifts the obtained sum by one bit to obtain a value H-(l+3,kp,l+3).例文帳に追加
同様に、H~(l+4,k_p,l+4)とビットシフト回路22の出力を加算器24で加算し、ビットシフト回路26でビットシフトしてH~(l+3,k_p,l+3)を得る。 - 特許庁
The upper polysilicone layer of a capacity Ch(h-1) to Ch1 corresponding to a high-order bit (H-DAC) is all connected to a common node on the side of the high-order bit and each lower polysilicone layer is connected to analog switches SWh(h-1) to SWh1.例文帳に追加
上位ビット(H−DAC)に対応する容量C_h(h-1)〜C_h1の上層ポリシリコンを全て上位ビット側の共通ノードに接続すると共に下層ポリシリコンの各々を対応するアナログスイッチSW_h(h-1)〜SW_h1に接続する。 - 特許庁
To provide a bit rate conversion device suitable for a DVB-H signal.例文帳に追加
DVB−H信号に適したビットレート変換装置を提供する。 - 特許庁
An adder 21 of this OFDM receiver sums pilot signal transmission line response estimate values H-(l,kp,l) and H-(l+4,kp,l+4) using an adder 21, a bit shift circuit 22 shifts the sum by 1-bit to obtain a value H-(l+2,kp,l+2).例文帳に追加
パイロット信号の伝送路応答推定値H~(l,k_p,l)とH~(l+4,k_p,l+4)を加算器21で加算し、ビットシフト回路22で1ビットシフトしてH~(l+2,k_p,l+2)を得る。 - 特許庁
This invention is applicable to, for example, an image decoder which decodes a bit stream encoded by H.264/AVC.例文帳に追加
本発明は、例えば、H.264/AVC方式で符号化されたビットストリームを復号する画像復号装置に適用することができる。 - 特許庁
M is a parallel width and H(k) is a bit length of the fraction data block B(x).例文帳に追加
Mは並列幅であり、H(k)は端数データブロックB(x)のビット長である。 - 特許庁
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